sound/soc/fsl/fsl_asrc.h

   1 /*
   2  * fsl_asrc.h - Freescale ASRC ALSA SoC header file
   3  *
   4  * Copyright (C) 2014-2015 Freescale Semiconductor, Inc.
   5  *
   6  * Author: Nicolin Chen <nicoleotsuka@gmail.com>
   7  *
   8  * This file is licensed under the terms of the GNU General Public License
   9  * version 2. This program is licensed "as is" without any warranty of any
  10  * kind, whether express or implied.
  11  */
  12
  13 #ifndef _FSL_ASRC_H
  14 #define _FSL_ASRC_H
  15
  16 #include <uapi/linux/mxc_asrc.h>
  17
  18 #define IN      0
  19 #define OUT     1
  20
  21 #define ASRC_DMA_BUFFER_NUM             2
  22 #define ASRC_INPUTFIFO_THRESHOLD        32
  23 #define ASRC_OUTPUTFIFO_THRESHOLD       32
  24 #define ASRC_FIFO_THRESHOLD_MIN         0
  25 #define ASRC_FIFO_THRESHOLD_MAX         63
  26 #define ASRC_DMA_BUFFER_SIZE            (1024 * 48 * 4)
  27 #define ASRC_MAX_BUFFER_SIZE            (1024 * 48)
  28 #define ASRC_OUTPUT_LAST_SAMPLE_MAX     32
  29 #define ASRC_OUTPUT_LAST_SAMPLE         16
  30
  31 #define IDEAL_RATIO_RATE                200000
  32
  33 #define REG_ASRCTR                      0x00
  34 #define REG_ASRIER                      0x04
  35 #define REG_ASRCNCR                     0x0C
  36 #define REG_ASRCFG                      0x10
  37 #define REG_ASRCSR                      0x14
  38
  39 #define REG_ASRCDR1                     0x18
  40 #define REG_ASRCDR2                     0x1C
  41 #define REG_ASRCDR(i)                   ((i < 2) ? REG_ASRCDR1 : REG_ASRCDR2)
  42
  43 #define REG_ASRSTR                      0x20
  44 #define REG_ASRRA                       0x24
  45 #define REG_ASRRB                       0x28
  46 #define REG_ASRRC                       0x2C
  47 #define REG_ASRPM1                      0x40
  48 #define REG_ASRPM2                      0x44
  49 #define REG_ASRPM3                      0x48
  50 #define REG_ASRPM4                      0x4C
  51 #define REG_ASRPM5                      0x50
  52 #define REG_ASRTFR1                     0x54
  53 #define REG_ASRCCR                      0x5C
  54
  55 #define REG_ASRDIA                      0x60
  56 #define REG_ASRDOA                      0x64
  57 #define REG_ASRDIB                      0x68
  58 #define REG_ASRDOB                      0x6C
  59 #define REG_ASRDIC                      0x70
  60 #define REG_ASRDOC                      0x74
  61 #define REG_ASRDI(i)                    (REG_ASRDIA + (i << 3))
  62 #define REG_ASRDO(i)                    (REG_ASRDOA + (i << 3))
  63 #define REG_ASRDx(x, i)                 (x == IN ? REG_ASRDI(i) : REG_ASRDO(i))
  64
  65 #define REG_ASRIDRHA                    0x80
  66 #define REG_ASRIDRLA                    0x84
  67 #define REG_ASRIDRHB                    0x88
  68 #define REG_ASRIDRLB                    0x8C
  69 #define REG_ASRIDRHC                    0x90
  70 #define REG_ASRIDRLC                    0x94
  71 #define REG_ASRIDRH(i)                  (REG_ASRIDRHA + (i << 3))
  72 #define REG_ASRIDRL(i)                  (REG_ASRIDRLA + (i << 3))
  73
  74 #define REG_ASR76K                      0x98
  75 #define REG_ASR56K                      0x9C
  76
  77 #define REG_ASRMCRA                     0xA0
  78 #define REG_ASRFSTA                     0xA4
  79 #define REG_ASRMCRB                     0xA8
  80 #define REG_ASRFSTB                     0xAC
  81 #define REG_ASRMCRC                     0xB0
  82 #define REG_ASRFSTC                     0xB4
  83 #define REG_ASRMCR(i)                   (REG_ASRMCRA + (i << 3))
  84 #define REG_ASRFST(i)                   (REG_ASRFSTA + (i << 3))
  85
  86 #define REG_ASRMCR1A                    0xC0
  87 #define REG_ASRMCR1B                    0xC4
  88 #define REG_ASRMCR1C                    0xC8
  89 #define REG_ASRMCR1(i)                  (REG_ASRMCR1A + (i << 2))
  90
  91
  92 /* REG0 0x00 REG_ASRCTR */
  93 #define ASRCTR_ATSi_SHIFT(i)            (20 + i)
  94 #define ASRCTR_ATSi_MASK(i)             (1 << ASRCTR_ATSi_SHIFT(i))
  95 #define ASRCTR_ATS(i)                   (1 << ASRCTR_ATSi_SHIFT(i))
  96 #define ASRCTR_USRi_SHIFT(i)            (14 + (i << 1))
  97 #define ASRCTR_USRi_MASK(i)             (1 << ASRCTR_USRi_SHIFT(i))
  98 #define ASRCTR_USR(i)                   (1 << ASRCTR_USRi_SHIFT(i))
  99 #define ASRCTR_IDRi_SHIFT(i)            (13 + (i << 1))
 100 #define ASRCTR_IDRi_MASK(i)             (1 << ASRCTR_IDRi_SHIFT(i))
 101 #define ASRCTR_IDR(i)                   (1 << ASRCTR_IDRi_SHIFT(i))
 102 #define ASRCTR_SRST_SHIFT               4
 103 #define ASRCTR_SRST_MASK                (1 << ASRCTR_SRST_SHIFT)
 104 #define ASRCTR_SRST                     (1 << ASRCTR_SRST_SHIFT)
 105 #define ASRCTR_ASRCEi_SHIFT(i)          (1 + i)
 106 #define ASRCTR_ASRCEi_MASK(i)           (1 << ASRCTR_ASRCEi_SHIFT(i))
 107 #define ASRCTR_ASRCE(i)                 (1 << ASRCTR_ASRCEi_SHIFT(i))
 108 #define ASRCTR_ASRCEi_ALL_MASK          (0x7 << ASRCTR_ASRCEi_SHIFT(0))
 109 #define ASRCTR_ASRCEN_SHIFT             0
 110 #define ASRCTR_ASRCEN_MASK              (1 << ASRCTR_ASRCEN_SHIFT)
 111 #define ASRCTR_ASRCEN                   (1 << ASRCTR_ASRCEN_SHIFT)
 112
 113 /* REG1 0x04 REG_ASRIER */
 114 #define ASRIER_AFPWE_SHIFT              7
 115 #define ASRIER_AFPWE_MASK               (1 << ASRIER_AFPWE_SHIFT)
 116 #define ASRIER_AFPWE                    (1 << ASRIER_AFPWE_SHIFT)
 117 #define ASRIER_AOLIE_SHIFT              6
 118 #define ASRIER_AOLIE_MASK               (1 << ASRIER_AOLIE_SHIFT)
 119 #define ASRIER_AOLIE                    (1 << ASRIER_AOLIE_SHIFT)
 120 #define ASRIER_ADOEi_SHIFT(i)           (3 + i)
 121 #define ASRIER_ADOEi_MASK(i)            (1 << ASRIER_ADOEi_SHIFT(i))
 122 #define ASRIER_ADOE(i)                  (1 << ASRIER_ADOEi_SHIFT(i))
 123 #define ASRIER_ADIEi_SHIFT(i)           (0 + i)
 124 #define ASRIER_ADIEi_MASK(i)            (1 << ASRIER_ADIEi_SHIFT(i))
 125 #define ASRIER_ADIE(i)                  (1 << ASRIER_ADIEi_SHIFT(i))
 126
 127 /* REG2 0x0C REG_ASRCNCR */
 128 #define ASRCNCR_ANCi_SHIFT(i, b)        (b * i)
 129 #define ASRCNCR_ANCi_MASK(i, b)         (((1 << b) - 1) << ASRCNCR_ANCi_SHIFT(i, b))
 130 #define ASRCNCR_ANCi(i, v, b)           ((v << ASRCNCR_ANCi_SHIFT(i, b)) & ASRCNCR_ANCi_MASK(i, b))
 131
 132 /* REG3 0x10 REG_ASRCFG */
 133 #define ASRCFG_INIRQi_SHIFT(i)          (21 + i)
 134 #define ASRCFG_INIRQi_MASK(i)           (1 << ASRCFG_INIRQi_SHIFT(i))
 135 #define ASRCFG_INIRQi                   (1 << ASRCFG_INIRQi_SHIFT(i))
 136 #define ASRCFG_NDPRi_SHIFT(i)           (18 + i)
 137 #define ASRCFG_NDPRi_MASK(i)            (1 << ASRCFG_NDPRi_SHIFT(i))
 138 #define ASRCFG_NDPRi                    (1 << ASRCFG_NDPRi_SHIFT(i))
 139 #define ASRCFG_POSTMODi_SHIFT(i)        (8 + (i << 2))
 140 #define ASRCFG_POSTMODi_WIDTH           2
 141 #define ASRCFG_POSTMODi_MASK(i)         (((1 << ASRCFG_POSTMODi_WIDTH) - 1) << ASRCFG_POSTMODi_SHIFT(i))
 142 #define ASRCFG_POSTMOD(i, v)            ((v) << ASRCFG_POSTMODi_SHIFT(i))
 143 #define ASRCFG_POSTMODi_UP(i)           (0 << ASRCFG_POSTMODi_SHIFT(i))
 144 #define ASRCFG_POSTMODi_DCON(i)         (1 << ASRCFG_POSTMODi_SHIFT(i))
 145 #define ASRCFG_POSTMODi_DOWN(i)         (2 << ASRCFG_POSTMODi_SHIFT(i))
 146 #define ASRCFG_PREMODi_SHIFT(i)         (6 + (i << 2))
 147 #define ASRCFG_PREMODi_WIDTH            2
 148 #define ASRCFG_PREMODi_MASK(i)          (((1 << ASRCFG_PREMODi_WIDTH) - 1) << ASRCFG_PREMODi_SHIFT(i))
 149 #define ASRCFG_PREMOD(i, v)             ((v) << ASRCFG_PREMODi_SHIFT(i))
 150 #define ASRCFG_PREMODi_UP(i)            (0 << ASRCFG_PREMODi_SHIFT(i))
 151 #define ASRCFG_PREMODi_DCON(i)          (1 << ASRCFG_PREMODi_SHIFT(i))
 152 #define ASRCFG_PREMODi_DOWN(i)          (2 << ASRCFG_PREMODi_SHIFT(i))
 153 #define ASRCFG_PREMODi_BYPASS(i)        (3 << ASRCFG_PREMODi_SHIFT(i))
 154
 155 /* REG4 0x14 REG_ASRCSR */
 156 #define ASRCSR_AxCSi_WIDTH              4
 157 #define ASRCSR_AxCSi_MASK               ((1 << ASRCSR_AxCSi_WIDTH) - 1)
 158 #define ASRCSR_AOCSi_SHIFT(i)           (12 + (i << 2))
 159 #define ASRCSR_AOCSi_MASK(i)            (((1 << ASRCSR_AxCSi_WIDTH) - 1) << ASRCSR_AOCSi_SHIFT(i))
 160 #define ASRCSR_AOCS(i, v)               ((v) << ASRCSR_AOCSi_SHIFT(i))
 161 #define ASRCSR_AICSi_SHIFT(i)           (i << 2)
 162 #define ASRCSR_AICSi_MASK(i)            (((1 << ASRCSR_AxCSi_WIDTH) - 1) << ASRCSR_AICSi_SHIFT(i))
 163 #define ASRCSR_AICS(i, v)               ((v) << ASRCSR_AICSi_SHIFT(i))
 164
 165 /* REG5&6 0x18 & 0x1C REG_ASRCDR1 & ASRCDR2 */
 166 #define ASRCDRi_AxCPi_WIDTH             3
 167 #define ASRCDRi_AICPi_SHIFT(i)          (0 + (i % 2) * 6)
 168 #define ASRCDRi_AICPi_MASK(i)           (((1 << ASRCDRi_AxCPi_WIDTH) - 1) << ASRCDRi_AICPi_SHIFT(i))
 169 #define ASRCDRi_AICP(i, v)              ((v) << ASRCDRi_AICPi_SHIFT(i))
 170 #define ASRCDRi_AICDi_SHIFT(i)          (3 + (i % 2) * 6)
 171 #define ASRCDRi_AICDi_MASK(i)           (((1 << ASRCDRi_AxCPi_WIDTH) - 1) << ASRCDRi_AICDi_SHIFT(i))
 172 #define ASRCDRi_AICD(i, v)              ((v) << ASRCDRi_AICDi_SHIFT(i))
 173 #define ASRCDRi_AOCPi_SHIFT(i)          ((i < 2) ? 12 + i * 6 : 6)
 174 #define ASRCDRi_AOCPi_MASK(i)           (((1 << ASRCDRi_AxCPi_WIDTH) - 1) << ASRCDRi_AOCPi_SHIFT(i))
 175 #define ASRCDRi_AOCP(i, v)              ((v) << ASRCDRi_AOCPi_SHIFT(i))
 176 #define ASRCDRi_AOCDi_SHIFT(i)          ((i < 2) ? 15 + i * 6 : 9)
 177 #define ASRCDRi_AOCDi_MASK(i)           (((1 << ASRCDRi_AxCPi_WIDTH) - 1) << ASRCDRi_AOCDi_SHIFT(i))
 178 #define ASRCDRi_AOCD(i, v)              ((v) << ASRCDRi_AOCDi_SHIFT(i))
 179
 180 /* REG7 0x20 REG_ASRSTR */
 181 #define ASRSTR_DSLCNT_SHIFT             21
 182 #define ASRSTR_DSLCNT_MASK              (1 << ASRSTR_DSLCNT_SHIFT)
 183 #define ASRSTR_DSLCNT                   (1 << ASRSTR_DSLCNT_SHIFT)
 184 #define ASRSTR_ATQOL_SHIFT              20
 185 #define ASRSTR_ATQOL_MASK               (1 << ASRSTR_ATQOL_SHIFT)
 186 #define ASRSTR_ATQOL                    (1 << ASRSTR_ATQOL_SHIFT)
 187 #define ASRSTR_AOOLi_SHIFT(i)           (17 + i)
 188 #define ASRSTR_AOOLi_MASK(i)            (1 << ASRSTR_AOOLi_SHIFT(i))
 189 #define ASRSTR_AOOL(i)                  (1 << ASRSTR_AOOLi_SHIFT(i))
 190 #define ASRSTR_AIOLi_SHIFT(i)           (14 + i)
 191 #define ASRSTR_AIOLi_MASK(i)            (1 << ASRSTR_AIOLi_SHIFT(i))
 192 #define ASRSTR_AIOL(i)                  (1 << ASRSTR_AIOLi_SHIFT(i))
 193 #define ASRSTR_AODOi_SHIFT(i)           (11 + i)
 194 #define ASRSTR_AODOi_MASK(i)            (1 << ASRSTR_AODOi_SHIFT(i))
 195 #define ASRSTR_AODO(i)                  (1 << ASRSTR_AODOi_SHIFT(i))
 196 #define ASRSTR_AIDUi_SHIFT(i)           (8 + i)
 197 #define ASRSTR_AIDUi_MASK(i)            (1 << ASRSTR_AIDUi_SHIFT(i))
 198 #define ASRSTR_AIDU(i)                  (1 << ASRSTR_AIDUi_SHIFT(i))
 199 #define ASRSTR_FPWT_SHIFT               7
 200 #define ASRSTR_FPWT_MASK                (1 << ASRSTR_FPWT_SHIFT)
 201 #define ASRSTR_FPWT                     (1 << ASRSTR_FPWT_SHIFT)
 202 #define ASRSTR_AOLE_SHIFT               6
 203 #define ASRSTR_AOLE_MASK                (1 << ASRSTR_AOLE_SHIFT)
 204 #define ASRSTR_AOLE                     (1 << ASRSTR_AOLE_SHIFT)
 205 #define ASRSTR_AODEi_SHIFT(i)           (3 + i)
 206 #define ASRSTR_AODFi_MASK(i)            (1 << ASRSTR_AODEi_SHIFT(i))
 207 #define ASRSTR_AODF(i)                  (1 << ASRSTR_AODEi_SHIFT(i))
 208 #define ASRSTR_AIDEi_SHIFT(i)           (0 + i)
 209 #define ASRSTR_AIDEi_MASK(i)            (1 << ASRSTR_AIDEi_SHIFT(i))
 210 #define ASRSTR_AIDE(i)                  (1 << ASRSTR_AIDEi_SHIFT(i))
 211
 212 /* REG10 0x54 REG_ASRTFR1 */
 213 #define ASRTFR1_TF_BASE_WIDTH           7
 214 #define ASRTFR1_TF_BASE_SHIFT           6
 215 #define ASRTFR1_TF_BASE_MASK            (((1 << ASRTFR1_TF_BASE_WIDTH) - 1) << ASRTFR1_TF_BASE_SHIFT)
 216 #define ASRTFR1_TF_BASE(i)              ((i) << ASRTFR1_TF_BASE_SHIFT)
 217
 218 /*
 219  * REG22 0xA0 REG_ASRMCRA
 220  * REG24 0xA8 REG_ASRMCRB
 221  * REG26 0xB0 REG_ASRMCRC
 222  */
 223 #define ASRMCRi_ZEROBUFi_SHIFT          23
 224 #define ASRMCRi_ZEROBUFi_MASK           (1 << ASRMCRi_ZEROBUFi_SHIFT)
 225 #define ASRMCRi_ZEROBUFi                (1 << ASRMCRi_ZEROBUFi_SHIFT)
 226 #define ASRMCRi_EXTTHRSHi_SHIFT         22
 227 #define ASRMCRi_EXTTHRSHi_MASK          (1 << ASRMCRi_EXTTHRSHi_SHIFT)
 228 #define ASRMCRi_EXTTHRSHi               (1 << ASRMCRi_EXTTHRSHi_SHIFT)
 229 #define ASRMCRi_BUFSTALLi_SHIFT         21
 230 #define ASRMCRi_BUFSTALLi_MASK          (1 << ASRMCRi_BUFSTALLi_SHIFT)
 231 #define ASRMCRi_BUFSTALLi               (1 << ASRMCRi_BUFSTALLi_SHIFT)
 232 #define ASRMCRi_BYPASSPOLYi_SHIFT       20
 233 #define ASRMCRi_BYPASSPOLYi_MASK        (1 << ASRMCRi_BYPASSPOLYi_SHIFT)
 234 #define ASRMCRi_BYPASSPOLYi             (1 << ASRMCRi_BYPASSPOLYi_SHIFT)
 235 #define ASRMCRi_OUTFIFO_THRESHOLD_WIDTH 6
 236 #define ASRMCRi_OUTFIFO_THRESHOLD_SHIFT 12
 237 #define ASRMCRi_OUTFIFO_THRESHOLD_MASK  (((1 << ASRMCRi_OUTFIFO_THRESHOLD_WIDTH) - 1) << ASRMCRi_OUTFIFO_THRESHOLD_SHIFT)
 238 #define ASRMCRi_OUTFIFO_THRESHOLD(v)    (((v) << ASRMCRi_OUTFIFO_THRESHOLD_SHIFT) & ASRMCRi_OUTFIFO_THRESHOLD_MASK)
 239 #define ASRMCRi_RSYNIFi_SHIFT           11
 240 #define ASRMCRi_RSYNIFi_MASK            (1 << ASRMCRi_RSYNIFi_SHIFT)
 241 #define ASRMCRi_RSYNIFi                 (1 << ASRMCRi_RSYNIFi_SHIFT)
 242 #define ASRMCRi_RSYNOFi_SHIFT           10
 243 #define ASRMCRi_RSYNOFi_MASK            (1 << ASRMCRi_RSYNOFi_SHIFT)
 244 #define ASRMCRi_RSYNOFi                 (1 << ASRMCRi_RSYNOFi_SHIFT)
 245 #define ASRMCRi_INFIFO_THRESHOLD_WIDTH  6
 246 #define ASRMCRi_INFIFO_THRESHOLD_SHIFT  0
 247 #define ASRMCRi_INFIFO_THRESHOLD_MASK   (((1 << ASRMCRi_INFIFO_THRESHOLD_WIDTH) - 1) << ASRMCRi_INFIFO_THRESHOLD_SHIFT)
 248 #define ASRMCRi_INFIFO_THRESHOLD(v)     (((v) << ASRMCRi_INFIFO_THRESHOLD_SHIFT) & ASRMCRi_INFIFO_THRESHOLD_MASK)
 249
 250 /*
 251  * REG23 0xA4 REG_ASRFSTA
 252  * REG25 0xAC REG_ASRFSTB
 253  * REG27 0xB4 REG_ASRFSTC
 254  */
 255 #define ASRFSTi_OAFi_SHIFT              23
 256 #define ASRFSTi_OAFi_MASK               (1 << ASRFSTi_OAFi_SHIFT)
 257 #define ASRFSTi_OAFi                    (1 << ASRFSTi_OAFi_SHIFT)
 258 #define ASRFSTi_OUTPUT_FIFO_WIDTH       7
 259 #define ASRFSTi_OUTPUT_FIFO_SHIFT       12
 260 #define ASRFSTi_OUTPUT_FIFO_MASK        (((1 << ASRFSTi_OUTPUT_FIFO_WIDTH) - 1) << ASRFSTi_OUTPUT_FIFO_SHIFT)
 261 #define ASRFSTi_IAEi_SHIFT              11
 262 #define ASRFSTi_IAEi_MASK               (1 << ASRFSTi_OAFi_SHIFT)
 263 #define ASRFSTi_IAEi                    (1 << ASRFSTi_OAFi_SHIFT)
 264 #define ASRFSTi_INPUT_FIFO_WIDTH        7
 265 #define ASRFSTi_INPUT_FIFO_SHIFT        0
 266 #define ASRFSTi_INPUT_FIFO_MASK         ((1 << ASRFSTi_INPUT_FIFO_WIDTH) - 1)
 267
 268 /* REG28 0xC0 & 0xC4 & 0xC8 REG_ASRMCR1i */
 269 #define ASRMCR1i_IWD_WIDTH              3
 270 #define ASRMCR1i_IWD_SHIFT              9
 271 #define ASRMCR1i_IWD_MASK               (((1 << ASRMCR1i_IWD_WIDTH) - 1) << ASRMCR1i_IWD_SHIFT)
 272 #define ASRMCR1i_IWD(v)                 ((v) << ASRMCR1i_IWD_SHIFT)
 273 #define ASRMCR1i_IMSB_SHIFT             8
 274 #define ASRMCR1i_IMSB_MASK              (1 << ASRMCR1i_IMSB_SHIFT)
 275 #define ASRMCR1i_IMSB_MSB               (1 << ASRMCR1i_IMSB_SHIFT)
 276 #define ASRMCR1i_IMSB_LSB               (0 << ASRMCR1i_IMSB_SHIFT)
 277 #define ASRMCR1i_OMSB_SHIFT             2
 278 #define ASRMCR1i_OMSB_MASK              (1 << ASRMCR1i_OMSB_SHIFT)
 279 #define ASRMCR1i_OMSB_MSB               (1 << ASRMCR1i_OMSB_SHIFT)
 280 #define ASRMCR1i_OMSB_LSB               (0 << ASRMCR1i_OMSB_SHIFT)
 281 #define ASRMCR1i_OSGN_SHIFT             1
 282 #define ASRMCR1i_OSGN_MASK              (1 << ASRMCR1i_OSGN_SHIFT)
 283 #define ASRMCR1i_OSGN                   (1 << ASRMCR1i_OSGN_SHIFT)
 284 #define ASRMCR1i_OW16_SHIFT             0
 285 #define ASRMCR1i_OW16_MASK              (1 << ASRMCR1i_OW16_SHIFT)
 286 #define ASRMCR1i_OW16(v)                ((v) << ASRMCR1i_OW16_SHIFT)
 287
 288 #define ASRC_CLK_MAX_NUM        16
 289
 290
 291 struct dma_block {
 292         dma_addr_t dma_paddr;
 293         void *dma_vaddr;
 294         unsigned int length;
 295 };
 296
 297 /**
 298  * fsl_asrc_pair: ASRC Pair private data
 299  *
 300  * @asrc_priv: pointer to its parent module
 301  * @config: configuration profile
 302  * @error: error record
 303  * @index: pair index (ASRC_PAIR_A, ASRC_PAIR_B, ASRC_PAIR_C)
 304  * @channels: occupied channel number
 305  * @desc: input and output dma descriptors
 306  * @dma_chan: inputer and output DMA channels
 307  * @dma_data: private dma data
 308  * @pos: hardware pointer position
 309  * @private: pair private area
 310  */
 311 struct fsl_asrc_pair {
 312         struct fsl_asrc *asrc_priv;
 313         struct asrc_config *config;
 314         unsigned int error;
 315
 316         enum asrc_pair_index index;
 317         unsigned int channels;
 318
 319         struct dma_async_tx_descriptor *desc[2];
 320         struct dma_chan *dma_chan[2];
 321         struct imx_dma_data dma_data;
 322         unsigned int pos;
 323
 324         void *private;
 325 };
 326
 327 /**
 328  * fsl_asrc_pair: ASRC private data
 329  *
 330  * @dma_params_rx: DMA parameters for receive channel
 331  * @dma_params_tx: DMA parameters for transmit channel
 332  * @pdev: platform device pointer
 333  * @regmap: regmap handler
 334  * @paddr: physical address to the base address of registers
 335  * @mem_clk: clock source to access register
 336  * @ipg_clk: clock source to drive peripheral
 337  * @asrck_clk: clock sources to driver ASRC internal logic
 338  * @lock: spin lock for resource protection
 339  * @pair: pair pointers
 340  * @channel_bits: width of ASRCNCR register for each pair
 341  * @channel_avail: non-occupied channel numbers
 342  * @asrc_rate: default sample rate for ASoC Back-Ends
 343  * @asrc_width: default sample width for ASoC Back-Ends
 344  * @name: driver name
 345  */
 346 struct fsl_asrc {
 347         struct snd_dmaengine_dai_dma_data dma_params_rx;
 348         struct snd_dmaengine_dai_dma_data dma_params_tx;
 349         struct platform_device *pdev;
 350         struct regmap *regmap;
 351         unsigned long paddr;
 352         struct clk *mem_clk;
 353         struct clk *ipg_clk;
 354         struct clk *dma_clk;
 355         struct clk *asrck_clk[ASRC_CLK_MAX_NUM];
 356         spinlock_t lock;
 357
 358         struct snd_pcm_substream *substream[2];
 359         struct fsl_asrc_pair *pair[ASRC_PAIR_MAX_NUM];
 360         unsigned int channel_bits;
 361         unsigned int channel_avail;
 362
 363         int asrc_rate;
 364         int asrc_width;
 365
 366         u32 regcache_cfg;
 367
 368         char name[32];
 369 };
 370
 371 extern struct snd_soc_platform_driver fsl_asrc_platform;
 372 struct dma_chan *fsl_asrc_get_dma_channel(struct fsl_asrc_pair *pair, bool dir);
 373
 374 #endif /* _FSL_ASRC_H */