packages/hal/arm/mx51/rocky/v2_0/include/fsl_board.h

   1 #ifndef CYGONCE_FSL_BOARD_H
   2 #define CYGONCE_FSL_BOARD_H
   3
   4 //=============================================================================
   5 //
   6 //      Platform specific support (register layout, etc)
   7 //
   8 //=============================================================================
   9 //####ECOSGPLCOPYRIGHTBEGIN####
  10 // -------------------------------------------
  11 // This file is part of eCos, the Embedded Configurable Operating System.
  12 // Copyright (C) 1998, 1999, 2000, 2001, 2002 Red Hat, Inc.
  13 //
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  17 //
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  22 //
  23 // You should have received a copy of the GNU General Public License along
  24 // with eCos; if not, write to the Free Software Foundation, Inc.,
  25 // 59 Temple Place, Suite 330, Boston, MA 02111-1307 USA.
  26 //
  27 // As a special exception, if other files instantiate templates or use macros
  28 // or inline functions from this file, or you compile this file and link it
  29 // with other works to produce a work based on this file, this file does not
  30 // by itself cause the resulting work to be covered by the GNU General Public
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  32 // in accordance with section (3) of the GNU General Public License.
  33 //
  34 // This exception does not invalidate any other reasons why a work based on
  35 // this file might be covered by the GNU General Public License.
  36 //
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  38 // at http://sources.redhat.com/ecos/ecos-license/
  39 // -------------------------------------------
  40 //####ECOSGPLCOPYRIGHTEND####
  41 //===========================================================================
  42
  43 #include <cyg/hal/hal_soc.h>        // Hardware definitions
  44
  45 #define BOARD_CS_UART_BASE      (0x8000)
  46
  47 #define REDBOOT_IMAGE_SIZE      0x40000
  48
  49 #define PMIC_SPI_BASE                   CSPI1_BASE_ADDR
  50 #define PMIC_SPI_CHIP_SELECT_NO SPI_CTRL_CS0
  51 #define PMIC_SPI_SS_POL                 SPI_CFG_SS0_POL_HIGH
  52
  53 #define PBC_BASE                        CS0_BASE_ADDR
  54
  55 /* MX51 3-Stack SDRAM is from 0x40000000, 128M */
  56 #define SDRAM_BASE_ADDR CSD0_BASE_ADDR
  57 #define SDRAM_SIZE              0x20000000
  58 #define RAM_BANK0_BASE          SDRAM_BASE_ADDR
  59
  60 #endif /* CYGONCE_FSL_BOARD_H */