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mx51: rename ESDCTL_ESDCDLYGD to ESDCTL_ESDGPR to match Ref. Manual
authorLothar Waßmann <LW@KARO-electronics.de>
Fri, 8 Aug 2014 13:22:27 +0000 (15:22 +0200)
committerLothar Waßmann <LW@KARO-electronics.de>
Fri, 8 Aug 2014 13:22:27 +0000 (15:22 +0200)
packages/hal/arm/mx51/3stack/v2_0/include/hal_platform_setup.h
packages/hal/arm/mx51/babbage/v2_0/include/hal_platform_setup.h
packages/hal/arm/mx51/var/v2_0/include/hal_soc.h

index 8a52d7e52b972aea5b3b9e426d6939586d9919f8..d7771659ba31625d09249d3ca30fd91aece0b570 100644 (file)
@@ -202,7 +202,7 @@ DCDGEN(47, 4, ESDCTL_BASE_ADDR + ESDCTL_ESDSCR, 0x00008004)
 DCDGEN(48, 4, ESDCTL_BASE_ADDR + ESDCTL_ESDCTL0, 0xb2a20000)
 DCDGEN(49, 4, ESDCTL_BASE_ADDR + ESDCTL_ESDCTL1, 0xb2a20000)
 DCDGEN(50, 4, ESDCTL_BASE_ADDR + ESDCTL_ESDMISC, 0x000ad6d0)
-DCDGEN(51, 4, ESDCTL_BASE_ADDR + ESDCTL_ESDCDLYGD, 0x90000000)
+DCDGEN(51, 4, ESDCTL_BASE_ADDR + ESDCTL_ESDGPR, 0x90000000)
 DCDGEN(52, 4, ESDCTL_BASE_ADDR + ESDCTL_ESDSCR, 0x00000000)
 
 // Delay settings
index f6b29e89520479c414a51297c5cc0e3f9ae26149..9d8de5ec9b816dbaf29edcf2959d76eac862088b 100644 (file)
@@ -155,7 +155,7 @@ DCDGEN(51, 4, ESDCTL_BASE_ADDR + ESDCTL_ESDSCR, 0x00008004)
 DCDGEN(52, 4, ESDCTL_BASE_ADDR + ESDCTL_ESDCTL0, 0xb2a20000)
 DCDGEN(53, 4, ESDCTL_BASE_ADDR + ESDCTL_ESDCTL1, 0xb2a20000)
 DCDGEN(54, 4, ESDCTL_BASE_ADDR + ESDCTL_ESDMISC, 0x000ad6d0)
-DCDGEN(55, 4, ESDCTL_BASE_ADDR + ESDCTL_ESDCDLYGD, 0x90000000)
+DCDGEN(55, 4, ESDCTL_BASE_ADDR + ESDCTL_ESDGPR, 0x90000000)
 DCDGEN(56, 4, ESDCTL_BASE_ADDR + ESDCTL_ESDSCR, 0x00000000)
 
 image_len:           .long 256*1024
index 6ba27303a96cc4e0b91a71ca8d178f343ab77c1d..e543b02e2e5d2dd81d78f5c9d52094f2447ea6f8 100644 (file)
@@ -500,7 +500,7 @@ externC void plf_hardware_init(void);
 #define ESDCTL_ESDCDLY3                                0x28
 #define ESDCTL_ESDCDLY4                                0x2C
 #define ESDCTL_ESDCDLY5                                0x30
-#define ESDCTL_ESDCDLYGD                       0x34
+#define ESDCTL_ESDGPR                          0x34
 
 /* DPLL */
 #define PLL_DP_CTL                                     0x00