arch/arm/include/asm/arch-exynos/cpu.h

   1 /*
   2  * (C) Copyright 2010 Samsung Electronics
   3  * Minkyu Kang <mk7.kang@samsung.com>
   4  *
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   9  *
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  12  * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE.  See the
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  14  *
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  16  * along with this program; if not, write to the Free Software
  17  * Foundation, Inc., 59 Temple Place, Suite 330, Boston,
  18  * MA 02111-1307 USA
  19  *
  20  */
  21
  22 #ifndef _EXYNOS4_CPU_H
  23 #define _EXYNOS4_CPU_H
  24
  25 #define DEVICE_NOT_AVAILABLE            0
  26
  27 #define EXYNOS4_ADDR_BASE               0x10000000
  28
  29 /* EXYNOS4 */
  30 #define EXYNOS4_GPIO_PART3_BASE         0x03860000
  31 #define EXYNOS4_PRO_ID                  0x10000000
  32 #define EXYNOS4_SYSREG_BASE             0x10010000
  33 #define EXYNOS4_POWER_BASE              0x10020000
  34 #define EXYNOS4_SWRESET                 0x10020400
  35 #define EXYNOS4_CLOCK_BASE              0x10030000
  36 #define EXYNOS4_SYSTIMER_BASE           0x10050000
  37 #define EXYNOS4_WATCHDOG_BASE           0x10060000
  38 #define EXYNOS4_MIU_BASE                0x10600000
  39 #define EXYNOS4_DMC0_BASE               0x10400000
  40 #define EXYNOS4_DMC1_BASE               0x10410000
  41 #define EXYNOS4_GPIO_PART2_BASE         0x11000000
  42 #define EXYNOS4_GPIO_PART1_BASE         0x11400000
  43 #define EXYNOS4_FIMD_BASE               0x11C00000
  44 #define EXYNOS4_MIPI_DSIM_BASE          0x11C80000
  45 #define EXYNOS4_USBOTG_BASE             0x12480000
  46 #define EXYNOS4_MMC_BASE                0x12510000
  47 #define EXYNOS4_SROMC_BASE              0x12570000
  48 #define EXYNOS4_USBPHY_BASE             0x125B0000
  49 #define EXYNOS4_UART_BASE               0x13800000
  50 #define EXYNOS4_ADC_BASE                0x13910000
  51 #define EXYNOS4_PWMTIMER_BASE           0x139D0000
  52 #define EXYNOS4_MODEM_BASE              0x13A00000
  53 #define EXYNOS4_USBPHY_CONTROL          0x10020704
  54
  55 #define EXYNOS4_GPIO_PART4_BASE         DEVICE_NOT_AVAILABLE
  56
  57 /* EXYNOS5 */
  58 #define EXYNOS5_GPIO_PART4_BASE         0x03860000
  59 #define EXYNOS5_PRO_ID                  0x10000000
  60 #define EXYNOS5_CLOCK_BASE              0x10010000
  61 #define EXYNOS5_POWER_BASE              0x10040000
  62 #define EXYNOS5_SWRESET                 0x10040400
  63 #define EXYNOS5_SYSREG_BASE             0x10050000
  64 #define EXYNOS5_WATCHDOG_BASE           0x101D0000
  65 #define EXYNOS5_DMC_PHY0_BASE           0x10C00000
  66 #define EXYNOS5_DMC_PHY1_BASE           0x10C10000
  67 #define EXYNOS5_GPIO_PART3_BASE         0x10D10000
  68 #define EXYNOS5_DMC_CTRL_BASE           0x10DD0000
  69 #define EXYNOS5_GPIO_PART1_BASE         0x11400000
  70 #define EXYNOS5_MIPI_DSIM_BASE          0x11D00000
  71 #define EXYNOS5_MMC_BASE                0x12200000
  72 #define EXYNOS5_SROMC_BASE              0x12250000
  73 #define EXYNOS5_USBOTG_BASE             0x12480000
  74 #define EXYNOS5_USBPHY_BASE             0x12480000
  75 #define EXYNOS5_UART_BASE               0x12C00000
  76 #define EXYNOS5_PWMTIMER_BASE           0x12DD0000
  77 #define EXYNOS5_GPIO_PART2_BASE         0x13400000
  78 #define EXYNOS5_FIMD_BASE               0x14400000
  79
  80 #define EXYNOS5_ADC_BASE                DEVICE_NOT_AVAILABLE
  81 #define EXYNOS5_MODEM_BASE              DEVICE_NOT_AVAILABLE
  82
  83 #ifndef __ASSEMBLY__
  84 #include <asm/io.h>
  85 /* CPU detection macros */
  86 extern unsigned int s5p_cpu_id;
  87 extern unsigned int s5p_cpu_rev;
  88
  89 static inline int s5p_get_cpu_rev(void)
  90 {
  91         return s5p_cpu_rev;
  92 }
  93
  94 static inline void s5p_set_cpu_id(void)
  95 {
  96         s5p_cpu_id = readl(EXYNOS4_PRO_ID);
  97         s5p_cpu_id = (0xC000 | ((s5p_cpu_id & 0x00FFF000) >> 12));
  98
  99         /*
 100          * 0xC200: EXYNOS4210 EVT0
 101          * 0xC210: EXYNOS4210 EVT1
 102          */
 103         if (s5p_cpu_id == 0xC200) {
 104                 s5p_cpu_id |= 0x10;
 105                 s5p_cpu_rev = 0;
 106         } else if (s5p_cpu_id == 0xC210) {
 107                 s5p_cpu_rev = 1;
 108         }
 109 }
 110
 111 #define IS_SAMSUNG_TYPE(type, id)                       \
 112 static inline int cpu_is_##type(void)                   \
 113 {                                                       \
 114         return s5p_cpu_id == id ? 1 : 0;                \
 115 }
 116
 117 IS_SAMSUNG_TYPE(exynos4, 0xc210)
 118 IS_SAMSUNG_TYPE(exynos5, 0xc520)
 119
 120 #define SAMSUNG_BASE(device, base)                              \
 121 static inline unsigned int samsung_get_base_##device(void)      \
 122 {                                                               \
 123         if (cpu_is_exynos4())                                   \
 124                 return EXYNOS4_##base;                          \
 125         else if (cpu_is_exynos5())                              \
 126                 return EXYNOS5_##base;                          \
 127         else                                                    \
 128                 return 0;                                       \
 129 }
 130
 131 SAMSUNG_BASE(adc, ADC_BASE)
 132 SAMSUNG_BASE(clock, CLOCK_BASE)
 133 SAMSUNG_BASE(sysreg, SYSREG_BASE)
 134 SAMSUNG_BASE(fimd, FIMD_BASE)
 135 SAMSUNG_BASE(mipi_dsim, MIPI_DSIM_BASE)
 136 SAMSUNG_BASE(gpio_part1, GPIO_PART1_BASE)
 137 SAMSUNG_BASE(gpio_part2, GPIO_PART2_BASE)
 138 SAMSUNG_BASE(gpio_part3, GPIO_PART3_BASE)
 139 SAMSUNG_BASE(gpio_part4, GPIO_PART4_BASE)
 140 SAMSUNG_BASE(pro_id, PRO_ID)
 141 SAMSUNG_BASE(mmc, MMC_BASE)
 142 SAMSUNG_BASE(modem, MODEM_BASE)
 143 SAMSUNG_BASE(sromc, SROMC_BASE)
 144 SAMSUNG_BASE(swreset, SWRESET)
 145 SAMSUNG_BASE(timer, PWMTIMER_BASE)
 146 SAMSUNG_BASE(uart, UART_BASE)
 147 SAMSUNG_BASE(usb_phy, USBPHY_BASE)
 148 SAMSUNG_BASE(usb_otg, USBOTG_BASE)
 149 SAMSUNG_BASE(watchdog, WATCHDOG_BASE)
 150 SAMSUNG_BASE(power, POWER_BASE)
 151 #endif
 152
 153 #endif  /* _EXYNOS4_CPU_H */