drivers/gpu/drm/amd/amdgpu/clearstate_gfx9.h

   1
   2 /*
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   4 *
   5 *  Trade secret of Advanced Micro Devices, Inc.
   6 *  Copyright (c) 2010 Advanced Micro Devices, Inc. (unpublished)
   7 *
   8 *  All rights reserved.  This notice is intended as a precaution against inadvertent publication and
   9 *  does not imply publication or any waiver of confidentiality.  The year included in the foregoing
  10 *  notice is the year of creation of the work.
  11 *
  12 ***************************************************************************************************
  13 */
  14 /**
  15 ***************************************************************************************************
  16 * @brief gfx9 Clearstate Definitions
  17 ***************************************************************************************************
  18 *
  19 *   Do not edit! This is a machine-generated file!
  20 *
  21 */
  22
  23 static const unsigned int gfx9_SECT_CONTEXT_def_1[] =
  24 {
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 238 static const unsigned int gfx9_SECT_CONTEXT_def_2[] =
 239 {
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 480     0, // HOLE
 481     0, // HOLE
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 490     0, // HOLE
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 522 };
 523 static const unsigned int gfx9_SECT_CONTEXT_def_3[] =
 524 {
 525     0x00000000, // PA_CL_POINT_X_RAD
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 529 };
 530 static const unsigned int gfx9_SECT_CONTEXT_def_4[] =
 531 {
 532     0x00000000, // DB_DEPTH_CONTROL
 533     0x00000000, // DB_EQAA
 534     0x00000000, // CB_COLOR_CONTROL
 535     0x00000000, // DB_SHADER_CONTROL
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 540     0x00000000, // PA_CL_NANINF_CNTL
 541     0x00000000, // PA_SU_LINE_STIPPLE_CNTL
 542     0x00000000, // PA_SU_LINE_STIPPLE_SCALE
 543     0x00000000, // PA_SU_PRIM_FILTER_CNTL
 544     0x00000000, // PA_SU_SMALL_PRIM_FILTER_CNTL
 545     0x00000000, // PA_CL_OBJPRIM_ID_CNTL
 546     0x00000000, // PA_CL_NGG_CNTL
 547     0x00000000, // PA_SU_OVER_RASTERIZATION_CNTL
 548     0, // HOLE
 549     0, // HOLE
 550     0, // HOLE
 551     0, // HOLE
 552     0, // HOLE
 553     0, // HOLE
 554     0, // HOLE
 555     0, // HOLE
 556     0, // HOLE
 557     0, // HOLE
 558     0, // HOLE
 559     0, // HOLE
 560     0, // HOLE
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 564     0, // HOLE
 565     0, // HOLE
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 567     0, // HOLE
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 570     0, // HOLE
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 581     0, // HOLE
 582     0, // HOLE
 583     0, // HOLE
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 585     0, // HOLE
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 588     0, // HOLE
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 591     0, // HOLE
 592     0, // HOLE
 593     0, // HOLE
 594     0, // HOLE
 595     0, // HOLE
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 598     0, // HOLE
 599     0, // HOLE
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 632     0, // HOLE
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 660     0x00000000, // PA_SU_POINT_SIZE
 661     0x00000000, // PA_SU_POINT_MINMAX
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 663     0x00000000, // PA_SC_LINE_STIPPLE
 664     0x00000000, // VGT_OUTPUT_PATH_CNTL
 665     0x00000000, // VGT_HOS_CNTL
 666     0x00000000, // VGT_HOS_MAX_TESS_LEVEL
 667     0x00000000, // VGT_HOS_MIN_TESS_LEVEL
 668     0x00000000, // VGT_HOS_REUSE_DEPTH
 669     0x00000000, // VGT_GROUP_PRIM_TYPE
 670     0x00000000, // VGT_GROUP_FIRST_DECR
 671     0x00000000, // VGT_GROUP_DECR
 672     0x00000000, // VGT_GROUP_VECT_0_CNTL
 673     0x00000000, // VGT_GROUP_VECT_1_CNTL
 674     0x00000000, // VGT_GROUP_VECT_0_FMT_CNTL
 675     0x00000000, // VGT_GROUP_VECT_1_FMT_CNTL
 676     0x00000000, // VGT_GS_MODE
 677     0x00000000, // VGT_GS_ONCHIP_CNTL
 678     0x00000000, // PA_SC_MODE_CNTL_0
 679     0x00000000, // PA_SC_MODE_CNTL_1
 680     0x00000000, // VGT_ENHANCE
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 682     0x00000080, // VGT_ES_PER_GS
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 938 static const struct cs_section_def gfx9_cs_data[] = {
 939     { gfx9_SECT_CONTEXT_defs, SECT_CONTEXT },
 940     { 0, SECT_NONE }
 941 };