]> git.kernelconcepts.de Git - karo-tx-redboot.git/blob - packages/hal/h8300/aki3068net/v2_0/cdl/hal_h8300_h8300h_aki3068net.cdl
Initial revision
[karo-tx-redboot.git] / packages / hal / h8300 / aki3068net / v2_0 / cdl / hal_h8300_h8300h_aki3068net.cdl
1 # ====================================================================
2 #
3 #      hal_h8300_h8300h_sim.cdl
4 #
5 #      AKI3068NET board HAL package configuration data
6 #
7 # ====================================================================
8 #####ECOSGPLCOPYRIGHTBEGIN####
9 ## -------------------------------------------
10 ## This file is part of eCos, the Embedded Configurable Operating System.
11 ## Copyright (C) 1998, 1999, 2000, 2001, 2002 Red Hat, Inc.
12 ##
13 ## eCos is free software; you can redistribute it and/or modify it under
14 ## the terms of the GNU General Public License as published by the Free
15 ## Software Foundation; either version 2 or (at your option) any later version.
16 ##
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18 ## WARRANTY; without even the implied warranty of MERCHANTABILITY or
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20 ## for more details.
21 ##
22 ## You should have received a copy of the GNU General Public License along
23 ## with eCos; if not, write to the Free Software Foundation, Inc.,
24 ## 59 Temple Place, Suite 330, Boston, MA 02111-1307 USA.
25 ##
26 ## As a special exception, if other files instantiate templates or use macros
27 ## or inline functions from this file, or you compile this file and link it
28 ## with other works to produce a work based on this file, this file does not
29 ## by itself cause the resulting work to be covered by the GNU General Public
30 ## License. However the source code for this file must still be made available
31 ## in accordance with section (3) of the GNU General Public License.
32 ##
33 ## This exception does not invalidate any other reasons why a work based on
34 ## this file might be covered by the GNU General Public License.
35 ##
36 ## Alternative licenses for eCos may be arranged by contacting Red Hat, Inc.
37 ## at http://sources.redhat.com/ecos/ecos-license/
38 ## -------------------------------------------
39 #####ECOSGPLCOPYRIGHTEND####
40 # ====================================================================
41 ######DESCRIPTIONBEGIN####
42 #
43 # Author(s):      yoshinori sato
44 # Original data:  bartv
45 # Contributors:   yoshinori sato
46 # Date:           2002-04-10
47 #
48 #####DESCRIPTIONEND####
49 #
50 # ====================================================================
51
52 cdl_package CYGPKG_HAL_H8300_H8300H_AKI3068NET {
53     display  "AKI3068NET"
54     parent        CYGPKG_HAL_H8300
55     requires CYGPKG_HAL_H8300_H8300H
56     implements CYGINT_HAL_VIRTUAL_VECTOR_SUPPORT
57     implements    CYGINT_HAL_DEBUG_GDB_STUBS
58     implements    CYGINT_HAL_DEBUG_GDB_STUBS_BREAK
59     define_header hal_h8300_h8300h_aki3068net.h
60     include_dir   cyg/hal
61     description   "
62            The aki HAL package provides the support needed to run
63            eCos on a Akizuki H8/3068 Network micom board." 
64
65     compile       hal_diag.c plf_misc.c delay_us.S plf_ide.c
66
67     define_proc {
68         puts $::cdl_system_header "#define CYGBLD_HAL_TARGET_H <pkgconf/hal_h8300_h8300h.h>"
69         puts $::cdl_system_header "#define CYGBLD_HAL_PLATFORM_H <pkgconf/hal_h8300_h8300h_aki3068net.h>"
70         puts $::cdl_system_header "#define CYGBLD_HAL_PLATFORM_IO_H <cyg/hal/plf_io.h>"
71
72         puts $::cdl_header "#define CYG_HAL_H8300"
73         puts $::cdl_header "#define CYGNUM_HAL_H8300_SCI_PORTS 1"
74         puts $::cdl_header "#define CYGHWR_HAL_VECTOR_TABLE 0xfffe20"
75         puts $::cdl_header "#define HAL_PLATFORM_CPU    \"H8/300H\""
76         puts $::cdl_header "#define HAL_PLATFORM_BOARD  \"Akizuki H8/3068 Network micom\""
77         puts $::cdl_header "#define HAL_PLATFORM_EXTRA  \"\""
78     }
79
80     cdl_component CYG_HAL_STARTUP {
81         display       "Startup type"
82         flavor        data
83         legal_values  {"ROM" "RAM"}
84         default_value {"ROM"}
85         no_define
86         define -file system.h CYG_HAL_STARTUP
87         description   "
88            When targetting the AKI3068NET board it is possible to
89            build the system for either RAM bootstrap or ROM bootstrap.
90            RAM bootstrap generally requires that the board
91            is equipped with ROMs containing a suitable ROM monitor or
92            equivalent software that allows GDB to download the eCos
93            application and extend Memory on to the board. 
94            The ROM bootstrap typically
95            requires that the eCos application be blown into EPROMs or
96            equivalent technology."
97     }
98
99     cdl_option CYGNUM_HAL_VIRTUAL_VECTOR_COMM_CHANNELS {
100         display      "Number of communication channels on the board"
101         flavor       data
102         calculated   1
103     }
104
105     cdl_option CYGNUM_HAL_VIRTUAL_VECTOR_DEBUG_CHANNEL {
106         display          "Debug serial port"
107         flavor data
108         legal_values     0 to CYGNUM_HAL_VIRTUAL_VECTOR_COMM_CHANNELS-1
109         default_value    0
110         description      "
111            The AKI3068NET board has only one serial port. This option
112            chooses which port will be used to connect to a host
113            running GDB."
114     }
115
116     cdl_option CYGNUM_HAL_VIRTUAL_VECTOR_CONSOLE_CHANNEL {
117         display          "Diagnostic serial port"
118         flavor data
119         legal_values     0 to CYGNUM_HAL_VIRTUAL_VECTOR_COMM_CHANNELS-1
120         default_value    0
121         description      "
122            The CQ/7708 board has only one serial port.  This option
123            chooses which port will be used for diagnostic output."
124     }
125
126     # Real-time clock/counter specifics
127     cdl_component CYGNUM_HAL_RTC_CONSTANTS {
128         display       "Real-time clock constants."
129         flavor        none
130     
131         cdl_option CYGNUM_HAL_RTC_NUMERATOR {
132             display       "Real-time clock numerator"
133             flavor        data
134             default_value 1000000000
135         }
136         cdl_option CYGNUM_HAL_RTC_DENOMINATOR {
137             display       "Real-time clock denominator"
138             flavor        data
139             default_value 100
140         }
141         cdl_option CYGNUM_HAL_H8300_RTC_PRESCALE {
142             display       "Real-time clock base prescale"
143             flavor        data
144             calculated    8192
145         }
146         # Isn't a nice way to handle freq requirement!
147         cdl_option CYGNUM_HAL_RTC_PERIOD {
148             display       "Real-time clock period"
149             flavor        data
150             default_value 10
151         }
152     }
153
154     cdl_option CYGHWR_HAL_H8300_CPG_INPUT {
155         display "OSC/Clock Freqency"
156         flavor  data
157         default_value 20000000
158     }
159
160     cdl_option CYGHWR_HAL_AKI3068NET_EXTRAM {
161         display "Extend DRAM Using"
162         flavor  bool
163         default_value 1
164     }
165
166     cdl_option CYGHWR_HAL_AKI3068NET_IDE {
167         display "IDE I/F expand"
168         flavor  bool
169         default_value 0
170     }
171
172     cdl_component CYGBLD_GLOBAL_OPTIONS {
173         display "Global build options"
174         flavor  none
175         parent  CYGPKG_NONE
176         description   "
177             Global build options including control over
178             compiler flags, linker flags and choice of toolchain."
179
180
181         cdl_option CYGBLD_GLOBAL_COMMAND_PREFIX {
182             display "Global command prefix"
183             flavor  data
184             no_define
185             default_value { "h8300-elf" }
186             description "
187                 This option specifies the command prefix used when
188                 invoking the build tools."
189         }
190
191         cdl_option CYGBLD_GLOBAL_CFLAGS {
192             display "Global compiler flags"
193             flavor  data
194             no_define
195             default_value { "-Wall -Wpointer-arith -Wstrict-prototypes -Winline -Wundef -Woverloaded-virtual -g -O2 -mh -mint32 -fsigned-char -fdata-sections -fno-rtti -fno-exceptions -fvtable-gc -finit-priority" }
196             description   "
197                 This option controls the global compiler flags which
198                 are used to compile all packages by
199                 default. Individual packages may define
200                 options which override these global flags."
201         }
202
203         cdl_option CYGBLD_GLOBAL_LDFLAGS {
204             display "Global linker flags"
205             flavor  data
206             no_define
207             default_value { "-g -nostdlib -Wl,--gc-sections -Wl,-static -mrelax -mh -mint32" }
208             description   "
209                 This option controls the global linker flags. Individual
210                 packages may define options which override these global flags."
211         }
212         cdl_option CYGBLD_BUILD_GDB_STUBS {
213             display "Build GDB stub ROM image"
214             default_value 0
215             requires CYGSEM_HAL_ROM_MONITOR
216             requires CYGBLD_BUILD_COMMON_GDB_STUBS
217             requires CYGDBG_HAL_DEBUG_GDB_INCLUDE_STUBS
218             requires CYGDBG_HAL_DEBUG_GDB_BREAK_SUPPORT
219             requires CYGDBG_HAL_DEBUG_GDB_THREAD_SUPPORT
220             no_define
221             description "
222                 This option enables the building of the GDB stubs for the
223                 board. The common HAL controls takes care of most of the
224                 build process, but the final conversion from ELF image to
225                 binary data is handled by the platform CDL, allowing
226                 relocation of the data if necessary."
227
228             make -priority 320 {
229                 <PREFIX>/bin/gdb_module.bin : <PREFIX>/bin/gdb_module.img
230                 $(OBJCOPY) -O binary $< $@
231             }
232         }
233     }
234
235     cdl_component CYGHWR_MEMORY_LAYOUT {
236         display "Memory layout"
237         flavor data
238         no_define
239         calculated { CYG_HAL_STARTUP == "RAM" ? "h8300_h8300h_aki3068net_ram" : \
240                                                 "h8300_h8300h_aki3068net_rom" }
241
242         cdl_option CYGHWR_MEMORY_LAYOUT_LDI {
243             display "Memory layout linker script fragment"
244             flavor data
245             no_define
246             define -file system.h CYGHWR_MEMORY_LAYOUT_LDI
247             calculated { CYG_HAL_STARTUP == "RAM" ? "<pkgconf/mlt_h8300_h8300h_aki3068net_ram.ldi>" : \
248                                                     "<pkgconf/mlt_h8300_h8300h_aki3068net_rom.ldi>" }
249         }
250
251         cdl_option CYGHWR_MEMORY_LAYOUT_H {
252             display "Memory layout header file"
253             flavor data
254             no_define
255             define -file system.h CYGHWR_MEMORY_LAYOUT_H
256             calculated { CYG_HAL_STARTUP == "RAM" ? "<pkgconf/mlt_h8300_h8300h_aki3068net_ram.h>" : \
257                                                     "<pkgconf/mlt_h8300_h8300h_aki3068net_rom.h>" }
258         }
259     }
260
261     cdl_component CYGHWR_AKI3068NET_IDE_OPTIONS {
262         display "IDE Expand Setting"
263         flavor  none
264         parent  CYGPKG_NONE
265         active_if CYGHWR_HAL_AKI3068NET_IDE
266         implements CYGINT_HAL_PLF_IF_IDE
267         description   "
268             IDE Expand Hardware Setting."
269
270         cdl_option CYGHWR_HAL_IDE_REGISTER {
271             display "IDE Register base address"
272             flavor  data
273             default_value 0x600000
274         }
275
276         cdl_option CYGHWR_HAL_IDE_ALT_REGS {
277             display "IDE AlternateRegister base address"
278             flavor  data
279             default_value 0x600020
280         }
281
282         cdl_option CYGHWR_HAL_IDE_BUSWIDTH {
283             display "IDE bus width"
284             flavor  data
285             legal_values  {8 16}
286             default_value 8
287         }
288     }
289
290     cdl_option CYGSEM_HAL_ROM_MONITOR {
291         display       "Behave as a ROM monitor"
292         flavor        bool
293         default_value 0
294         parent        CYGPKG_HAL_ROM_MONITOR
295         requires      { CYG_HAL_STARTUP == "ROM" }
296         description   "
297             Enable this option if this program is to be used as a ROM monitor,
298             i.e. applications will be loaded into RAM on the board, and this
299             ROM monitor may process exceptions or interrupts generated from the
300             application. This enables features such as utilizing a separate
301             interrupt stack when exceptions are generated."
302     }
303     cdl_option CYGHWR_HAL_H8300_VECTOR_ADDRESS {
304         display       "Hook Vector Address"
305         flavor        data
306         default_value 0xfffd20
307         active_if CYGSEM_HAL_H8300_VECTOR_HOOK
308         parent        CYGPKG_HAL_ROM_MONITOR
309         description   "
310             Hooking Vector Table Address"
311     }
312     cdl_option CYGHAL_PLF_SCI_BASE {
313         display "SCI Base address"
314         flavor data
315         default_value 0xffffb8
316         description   "
317             Used SCI Channel base address."
318     }
319     cdl_option CYGDAT_REDBOOT_H8300_LINUX_COMMAND_START {
320         display        "Default kernel command line start address"
321         flavor         data
322         default_value  0x5ffe00
323         description    "
324            This option uClinux kernel command line start address of default."
325     }
326
327     cdl_option CYGDAT_REDBOOT_H8300_LINUX_BOOT_COMMAND_LINE {
328         display        "Default command line"
329         flavor         data
330         default_value  { "console=/dev/ttySC1" }
331         description    "
332            This option uClinux kernel startup command line of default."
333     }
334 }