include/configs/aev.h

   1 /*
   2  * (C) Copyright 2003-2006
   3  * Wolfgang Denk, DENX Software Engineering, wd@denx.de.
   4  *
   5  * (C) Copyright 2004-2005
   6  * Martin Krause, TQ-Systems GmbH, martin.krause@tqs.de
   7  *
   8  * See file CREDITS for list of people who contributed to this
   9  * project.
  10  *
  11  * This program is free software; you can redistribute it and/or
  12  * modify it under the terms of the GNU General Public License as
  13  * published by the Free Software Foundation; either version 2 of
  14  * the License, or (at your option) any later version.
  15  *
  16  * This program is distributed in the hope that it will be useful,
  17  * but WITHOUT ANY WARRANTY; without even the implied warranty of
  18  * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE.  See the
  19  * GNU General Public License for more details.
  20  *
  21  * You should have received a copy of the GNU General Public License
  22  * along with this program; if not, write to the Free Software
  23  * Foundation, Inc., 59 Temple Place, Suite 330, Boston,
  24  * MA 02111-1307 USA
  25  */
  26
  27 #ifndef __CONFIG_H
  28 #define __CONFIG_H
  29
  30 /*
  31  * High Level Configuration Options
  32  * (easy to change)
  33  */
  34
  35 #define CONFIG_MPC5xxx          1       /* This is an MPC5xxx CPU */
  36 #define CONFIG_MPC5200          1       /* (more precisely an MPC5200 CPU) */
  37 #define CONFIG_TQM5200          1       /* ... on TQM5200 module */
  38 #undef CONFIG_TQM5200_REV100            /*  define for revision 100 modules */
  39 #define CONFIG_STK52XX          1       /* ... on a STK52XX base board */
  40 #define CONFIG_STK52XX_REV100   1       /*  define for revision 100 baseboards */
  41 #define CONFIG_AEVFIFO          1
  42 #define CONFIG_SYS_MPC5XXX_CLKIN        33000000 /* ... running at 33.000000MHz */
  43
  44 /*
  45  * Valid values for CONFIG_SYS_TEXT_BASE are:
  46  * 0xFC000000   boot low (standard configuration with room for
  47  *              max 64 MByte Flash ROM)
  48  * 0xFFF00000   boot high (for a backup copy of U-Boot)
  49  * 0x00100000   boot from RAM (for testing only)
  50  */
  51 #ifndef CONFIG_SYS_TEXT_BASE
  52 #define CONFIG_SYS_TEXT_BASE    0xFC000000
  53 #endif
  54
  55 #define CONFIG_HIGH_BATS        1       /* High BATs supported */
  56
  57 /*
  58  * Serial console configuration
  59  */
  60 #define CONFIG_PSC_CONSOLE      1       /* console is on PSC1 */
  61 #define CONFIG_BAUDRATE         115200  /* ... at 115200 bps */
  62 #define CONFIG_SYS_BAUDRATE_TABLE       { 9600, 19200, 38400, 57600, 115200, 230400 }
  63
  64 /*
  65  * PCI Mapping:
  66  * 0x40000000 - 0x4fffffff - PCI Memory
  67  * 0x50000000 - 0x50ffffff - PCI IO Space
  68  */
  69 #ifdef CONFIG_AEVFIFO
  70 #define CONFIG_PCI              1
  71 #define CONFIG_PCI_PNP          1
  72 /* #define CONFIG_PCI_SCAN_SHOW 1 */
  73 #define CONFIG_PCIAUTO_SKIP_HOST_BRIDGE         1
  74
  75 #define CONFIG_PCI_MEM_BUS      0x40000000
  76 #define CONFIG_PCI_MEM_PHYS     CONFIG_PCI_MEM_BUS
  77 #define CONFIG_PCI_MEM_SIZE     0x10000000
  78
  79 #define CONFIG_PCI_IO_BUS       0x50000000
  80 #define CONFIG_PCI_IO_PHYS      CONFIG_PCI_IO_BUS
  81 #define CONFIG_PCI_IO_SIZE      0x01000000
  82
  83 #define CONFIG_EEPRO100         1
  84 #define CONFIG_SYS_RX_ETH_BUFFER        8  /* use 8 rx buffer on eepro100  */
  85 #define CONFIG_NS8382X          1
  86 #endif  /* CONFIG_AEVFIFO */
  87
  88 /* Partitions */
  89 #define CONFIG_MAC_PARTITION
  90 #define CONFIG_DOS_PARTITION
  91 #define CONFIG_ISO_PARTITION
  92
  93 /* POST support */
  94 #define CONFIG_POST             (CONFIG_SYS_POST_MEMORY   | \
  95                                  CONFIG_SYS_POST_CPU       | \
  96                                  CONFIG_SYS_POST_I2C)
  97
  98 #ifdef CONFIG_POST
  99 /* preserve space for the post_word at end of on-chip SRAM */
 100 #define MPC5XXX_SRAM_POST_SIZE MPC5XXX_SRAM_SIZE-4
 101 #endif
 102
 103
 104 /*
 105  * BOOTP options
 106  */
 107 #define CONFIG_BOOTP_BOOTFILESIZE
 108 #define CONFIG_BOOTP_BOOTPATH
 109 #define CONFIG_BOOTP_GATEWAY
 110 #define CONFIG_BOOTP_HOSTNAME
 111
 112
 113 /*
 114  * Command line configuration.
 115  */
 116 #include <config_cmd_default.h>
 117
 118 #define CONFIG_CMD_ASKENV
 119 #define CONFIG_CMD_DATE
 120 #define CONFIG_CMD_DHCP
 121 #define CONFIG_CMD_ECHO
 122 #define CONFIG_CMD_EEPROM
 123 #define CONFIG_CMD_I2C
 124 #define CONFIG_CMD_MII
 125 #define CONFIG_CMD_NFS
 126 #define CONFIG_CMD_PCI
 127 #define CONFIG_CMD_PING
 128 #define CONFIG_CMD_REGINFO
 129 #define CONFIG_CMD_SNTP
 130
 131 #ifdef CONFIG_POST
 132 #define CONFIG_CMD_DIAG
 133 #endif
 134
 135
 136 #define CONFIG_TIMESTAMP                /* display image timestamps */
 137
 138 #if (CONFIG_SYS_TEXT_BASE == 0xFC000000)                /* Boot low */
 139 #   define CONFIG_SYS_LOWBOOT           1
 140 #endif
 141
 142 /*
 143  * Autobooting
 144  */
 145 #define CONFIG_BOOTDELAY        5       /* autoboot after 5 seconds */
 146
 147 #define CONFIG_PREBOOT  "echo;" \
 148         "echo Type \\\"run flash_nfs\\\" to mount root filesystem over NFS;" \
 149         "echo"
 150
 151 #undef  CONFIG_BOOTARGS
 152
 153 #define CONFIG_EXTRA_ENV_SETTINGS                                       \
 154         "netdev=eth0\0"                                                 \
 155         "rootpath=/opt/eldk/ppc_6xx\0"                                  \
 156         "ramargs=setenv bootargs root=/dev/ram rw\0"                    \
 157         "nfsargs=setenv bootargs root=/dev/nfs rw "                     \
 158                 "nfsroot=${serverip}:${rootpath} "                      \
 159                 "console=ttyS0,${baudrate}\0"                           \
 160         "addip=setenv bootargs ${bootargs} "                            \
 161                 "ip=${ipaddr}:${serverip}:${gatewayip}:${netmask}"      \
 162                 ":${hostname}:${netdev}:off panic=1\0"                  \
 163         "flash_self=run ramargs addip;"                                 \
 164                 "bootm ${kernel_addr} ${ramdisk_addr}\0"                \
 165         "flash_nfs=run nfsargs addip;"                                  \
 166                 "bootm ${kernel_addr}\0"                                \
 167         "net_nfs=tftp 200000 ${bootfile};run nfsargs addip;bootm\0"     \
 168         "bootfile=/tftpboot/tqm5200/uImage\0"                           \
 169         "load=tftp 200000 ${u-boot}\0"                                  \
 170         "u-boot=/tftpboot/tqm5200/u-boot.bin\0"                         \
 171         "update=protect off FC000000 FC05FFFF;"                         \
 172                 "erase FC000000 FC05FFFF;"                              \
 173                 "cp.b 200000 FC000000 ${filesize};"                     \
 174                 "protect on FC000000 FC05FFFF\0"                        \
 175         ""
 176
 177 #define CONFIG_BOOTCOMMAND      "run net_nfs"
 178
 179 /*
 180  * IPB Bus clocking configuration.
 181  */
 182 #define CONFIG_SYS_IPBCLK_EQUALS_XLBCLK         /* define for 133MHz speed */
 183
 184 #if defined(CONFIG_SYS_IPBCLK_EQUALS_XLBCLK)
 185 /*
 186  * PCI Bus clocking configuration
 187  *
 188  * Actually a PCI Clock of 66 MHz is only set (in cpu_init.c) if
 189  * CONFIG_SYS_IPBCLK_EQUALS_XLBCLK is defined. This is because a PCI Clock
 190  * of 66 MHz yet hasn't been tested with a IPB Bus Clock of 66 MHz.
 191  */
 192 #define CONFIG_SYS_PCICLK_EQUALS_IPBCLK_DIV2    /* define for 66MHz speed */
 193 #endif
 194
 195 /*
 196  * I2C configuration
 197  */
 198 #define CONFIG_HARD_I2C         1       /* I2C with hardware support */
 199 #ifdef CONFIG_TQM5200_REV100
 200 #define CONFIG_SYS_I2C_MODULE           1       /* Select I2C module #1 for rev. 100 board */
 201 #else
 202 #define CONFIG_SYS_I2C_MODULE           2       /* Select I2C module #2 for all other revs */
 203 #endif
 204
 205 /*
 206  * I2C clock frequency
 207  *
 208  * Please notice, that the resulting clock frequency could differ from the
 209  * configured value. This is because the I2C clock is derived from system
 210  * clock over a frequency divider with only a few divider values. U-boot
 211  * calculates the best approximation for CONFIG_SYS_I2C_SPEED. However the calculated
 212  * approximation allways lies below the configured value, never above.
 213  */
 214 #define CONFIG_SYS_I2C_SPEED            100000 /* 100 kHz */
 215 #define CONFIG_SYS_I2C_SLAVE            0x7F
 216
 217 /*
 218  * EEPROM configuration for onboard EEPROM M24C32 (M24C64 should work
 219  * also). For other EEPROMs configuration should be verified. On Mini-FAP the
 220  * EEPROM (24C64) is on the same I2C address (but on other I2C bus), so the
 221  * same configuration could be used.
 222  */
 223 #define CONFIG_SYS_I2C_EEPROM_ADDR              0x50    /* 1010000x */
 224 #define CONFIG_SYS_I2C_EEPROM_ADDR_LEN          2
 225 #define CONFIG_SYS_EEPROM_PAGE_WRITE_BITS       5       /* =32 Bytes per write */
 226 #define CONFIG_SYS_EEPROM_PAGE_WRITE_DELAY_MS   20
 227
 228 /*
 229  * Flash configuration
 230  */
 231 #define CONFIG_SYS_FLASH_BASE           CONFIG_SYS_TEXT_BASE /* 0xFC000000 */
 232
 233 /* use CFI flash driver if no module variant is spezified */
 234 #define CONFIG_SYS_FLASH_CFI            1       /* Flash is CFI conformant */
 235 #define CONFIG_FLASH_CFI_DRIVER 1       /* Use the common driver */
 236 #define CONFIG_SYS_FLASH_BANKS_LIST     { CONFIG_SYS_BOOTCS_START }
 237 #define CONFIG_SYS_FLASH_EMPTY_INFO
 238 #define CONFIG_SYS_FLASH_SIZE           0x04000000 /* 64 MByte */
 239 #define CONFIG_SYS_MAX_FLASH_SECT       512     /* max num of sects on one chip */
 240 #undef CONFIG_SYS_FLASH_USE_BUFFER_WRITE        /* not supported yet for AMD */
 241
 242 #if !defined(CONFIG_SYS_LOWBOOT)
 243 #define CONFIG_ENV_ADDR         (CONFIG_SYS_FLASH_BASE + 0x00760000 + 0x00800000)
 244 #else   /* CONFIG_SYS_LOWBOOT */
 245 #define CONFIG_ENV_ADDR         (CONFIG_SYS_FLASH_BASE + 0x00060000)
 246 #endif  /* CONFIG_SYS_LOWBOOT */
 247 #define CONFIG_SYS_MAX_FLASH_BANKS      1       /* max num of flash banks
 248                                            (= chip selects) */
 249 #define CONFIG_SYS_FLASH_ERASE_TOUT     240000  /* Flash Erase Timeout (in ms)  */
 250 #define CONFIG_SYS_FLASH_WRITE_TOUT     500     /* Flash Write Timeout (in ms)  */
 251
 252
 253 /*
 254  * Environment settings
 255  */
 256 #define CONFIG_ENV_IS_IN_FLASH  1
 257 #define CONFIG_ENV_SIZE         0x10000
 258 #define CONFIG_ENV_SECT_SIZE    0x20000
 259 #define CONFIG_ENV_ADDR_REDUND  (CONFIG_ENV_ADDR + CONFIG_ENV_SECT_SIZE)
 260 #define CONFIG_ENV_SIZE_REDUND  (CONFIG_ENV_SIZE)
 261
 262 /*
 263  * Memory map
 264  */
 265 #define CONFIG_SYS_MBAR         0xF0000000
 266 #define CONFIG_SYS_SDRAM_BASE           0x00000000
 267 #define CONFIG_SYS_DEFAULT_MBAR 0x80000000
 268
 269 /* Use ON-Chip SRAM until RAM will be available */
 270 #define CONFIG_SYS_INIT_RAM_ADDR        MPC5XXX_SRAM
 271 #ifdef CONFIG_POST
 272 /* preserve space for the post_word at end of on-chip SRAM */
 273 #define CONFIG_SYS_INIT_RAM_SIZE        MPC5XXX_SRAM_POST_SIZE
 274 #else
 275 #define CONFIG_SYS_INIT_RAM_SIZE        MPC5XXX_SRAM_SIZE
 276 #endif
 277
 278
 279 #define CONFIG_SYS_GBL_DATA_OFFSET      (CONFIG_SYS_INIT_RAM_SIZE - GENERATED_GBL_DATA_SIZE)
 280 #define CONFIG_SYS_INIT_SP_OFFSET       CONFIG_SYS_GBL_DATA_OFFSET
 281
 282 #define CONFIG_SYS_MONITOR_BASE CONFIG_SYS_TEXT_BASE
 283 #if (CONFIG_SYS_MONITOR_BASE < CONFIG_SYS_FLASH_BASE)
 284 #   define CONFIG_SYS_RAMBOOT           1
 285 #endif
 286
 287 #define CONFIG_SYS_MONITOR_LEN          (384 << 10)     /* Reserve 384 kB for Monitor   */
 288 #define CONFIG_SYS_MALLOC_LEN           (128 << 10)     /* Reserve 128 kB for malloc()  */
 289 #define CONFIG_SYS_BOOTMAPSZ            (8 << 20)       /* Initial Memory map for Linux */
 290
 291 /*
 292  * Ethernet configuration
 293  */
 294 #define CONFIG_MPC5xxx_FEC      1
 295 #define CONFIG_MPC5xxx_FEC_MII100
 296 /*
 297  * Define CONFIG_MPC5xxx_FEC_MII10 to force FEC at 10Mb
 298  */
 299 /* #define CONFIG_MPC5xxx_FEC_MII10 */
 300 #define CONFIG_PHY_ADDR         0x00
 301
 302 /*
 303  * GPIO configuration
 304  *
 305  * use pin gpio_wkup_6 as second SDRAM chip select (mem_cs1):
 306  *      Bit 0 (mask: 0x80000000): 1
 307  * use ALT CAN position: Bits 2-3 (mask: 0x30000000):
 308  *      00 -> No Alternatives, CAN1/2 on PSC2 according to PSC2 setting.
 309  *      01 -> CAN1 on I2C1, CAN2 on Tmr0/1.
 310  *            Use for REV200 STK52XX boards. Do not use with REV100 modules
 311  *            (because, there I2C1 is used as I2C bus)
 312  * use PSC1 as UART: Bits 28-31 (mask: 0x00000007): 0100
 313  * use PSC2 as CAN: Bits 25:27 (mask: 0x00000030)
 314  *      000 -> All PSC2 pins are GIOPs
 315  *      001 -> CAN1/2 on PSC2 pins
 316  *             Use for REV100 STK52xx boards
 317  * use PSC6:
 318  *   on STK52xx:
 319  *      use as UART. Pins PSC6_0 to PSC6_3 are used.
 320  *      Bits 9:11 (mask: 0x00700000):
 321  *         101 -> PSC6 : Extended POST test is not available
 322  *   on MINI-FAP and TQM5200_IB:
 323  *      use PSC6_0 to PSC6_3 as GPIO: Bits 9:11 (mask: 0x00700000):
 324  *         000 -> PSC6 could not be used as UART, CODEC or IrDA
 325  *   GPIO on PSC6_3 is used in post_hotkeys_pressed() to enable extended POST
 326  *   tests.
 327  */
 328 #define CONFIG_SYS_GPS_PORT_CONFIG      0x81500014
 329
 330 /*
 331  * RTC configuration
 332  */
 333 #define CONFIG_RTC_MPC5200      1       /* use internal MPC5200 RTC */
 334
 335 /*
 336  * Miscellaneous configurable options
 337  */
 338 #define CONFIG_SYS_LONGHELP                     /* undef to save memory     */
 339 #define CONFIG_SYS_PROMPT               "=> "   /* Monitor Command Prompt   */
 340 #if defined(CONFIG_CMD_KGDB)
 341 #define CONFIG_SYS_CBSIZE               1024    /* Console I/O Buffer Size  */
 342 #else
 343 #define CONFIG_SYS_CBSIZE               256     /* Console I/O Buffer Size  */
 344 #endif
 345 #define CONFIG_SYS_PBSIZE (CONFIG_SYS_CBSIZE+sizeof(CONFIG_SYS_PROMPT)+16) /* Print Buffer Size */
 346 #define CONFIG_SYS_MAXARGS              16      /* max number of command args   */
 347 #define CONFIG_SYS_BARGSIZE             CONFIG_SYS_CBSIZE       /* Boot Argument Buffer Size    */
 348
 349 /* Enable an alternate, more extensive memory test */
 350 #define CONFIG_SYS_ALT_MEMTEST
 351
 352 #define CONFIG_SYS_MEMTEST_START        0x00100000      /* memtest works on */
 353 #define CONFIG_SYS_MEMTEST_END          0x00f00000      /* 1 ... 15 MB in DRAM  */
 354
 355 #define CONFIG_SYS_LOAD_ADDR            0x100000        /* default load address */
 356
 357 #define CONFIG_SYS_HZ                   1000    /* decrementer freq: 1 ms ticks */
 358
 359 #define CONFIG_SYS_CACHELINE_SIZE       32      /* For MPC5xxx CPUs */
 360 #if defined(CONFIG_CMD_KGDB)
 361 #  define CONFIG_SYS_CACHELINE_SHIFT    5       /* log base 2 of the above value */
 362 #endif
 363
 364 /*
 365  * Enable loopw command.
 366  */
 367 #define CONFIG_LOOPW
 368
 369 /*
 370  * Various low-level settings
 371  */
 372 #define CONFIG_SYS_HID0_INIT            HID0_ICE | HID0_ICFI
 373 #define CONFIG_SYS_HID0_FINAL           HID0_ICE
 374
 375 #define CONFIG_SYS_BOOTCS_START CONFIG_SYS_FLASH_BASE
 376 #define CONFIG_SYS_BOOTCS_SIZE          CONFIG_SYS_FLASH_SIZE
 377 #ifdef CONFIG_SYS_PCICLK_EQUALS_IPBCLK_DIV2
 378 #define CONFIG_SYS_BOOTCS_CFG           0x0008DF30 /* for pci_clk  = 66 MHz */
 379 #else
 380 #define CONFIG_SYS_BOOTCS_CFG           0x0004DF30 /* for pci_clk = 33 MHz */
 381 #endif
 382 #define CONFIG_SYS_CS0_START            CONFIG_SYS_FLASH_BASE
 383 #define CONFIG_SYS_CS0_SIZE             CONFIG_SYS_FLASH_SIZE
 384
 385 #define CONFIG_LAST_STAGE_INIT
 386
 387 /*
 388  * SRAM - Do not map below 2 GB in address space, because this area is used
 389  * for SDRAM autosizing.
 390  */
 391 #define CONFIG_SYS_CS2_START            0xE5000000
 392 #define CONFIG_SYS_CS2_SIZE             0x80000         /* 512 kByte */
 393 #define CONFIG_SYS_CS2_CFG              0x0004D930
 394
 395 /*
 396  * Grafic controller - Do not map below 2 GB in address space, because this
 397  * area is used for SDRAM autosizing.
 398  */
 399 #define SM501_FB_BASE           0xE0000000
 400 #define CONFIG_SYS_CS1_START           (SM501_FB_BASE)
 401 #define CONFIG_SYS_CS1_SIZE            0x4000000       /* 64 MByte */
 402 #define CONFIG_SYS_CS1_CFG             0x8F48FF70
 403 #define SM501_MMIO_BASE         CONFIG_SYS_CS1_START + 0x03E00000
 404
 405 #define CONFIG_SYS_CS_BURST            0x00000000
 406 #define CONFIG_SYS_CS_DEADCYCLE        0x33333311      /* 1 dead cycle for flash and SM501 */
 407
 408 #define CONFIG_SYS_RESET_ADDRESS        0xff000000
 409
 410 #endif /* __CONFIG_H */