include/configs/TQM834x.h

   1 /*
   2  * (C) Copyright 2005
   3  * Wolfgang Denk, DENX Software Engineering, wd@denx.de.
   4  *
   5  * See file CREDITS for list of people who contributed to this
   6  * project.
   7  *
   8  * This program is free software; you can redistribute it and/or
   9  * modify it under the terms of the GNU General Public License as
  10  * published by the Free Software Foundation; either version 2 of
  11  * the License, or (at your option) any later version.
  12  *
  13  * This program is distributed in the hope that it will be useful,
  14  * but WITHOUT ANY WARRANTY; without even the implied warranty of
  15  * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE.  See the
  16  * GNU General Public License for more details.
  17  *
  18  * You should have received a copy of the GNU General Public License
  19  * along with this program; if not, write to the Free Software
  20  * Foundation, Inc., 59 Temple Place, Suite 330, Boston,
  21  * MA 02111-1307 USA
  22  */
  23
  24 /*
  25  * TQM8349 board configuration file
  26  */
  27
  28 #ifndef __CONFIG_H
  29 #define __CONFIG_H
  30
  31 #define DEBUG
  32 #undef DEBUG
  33
  34 /*
  35  * High Level Configuration Options
  36  */
  37 #define CONFIG_E300             1       /* E300 Family */
  38 #define CONFIG_MPC83XX          1       /* MPC83XX family */
  39 #define CONFIG_MPC834X          1       /* MPC834X specific */
  40 #define CONFIG_TQM834X          1       /* TQM834X board specific */
  41
  42 /* IMMR Base Addres Register, use Freescale default: 0xff400000 */
  43 #define CFG_IMMRBAR             IMMRBAR_BASE_ADDR
  44
  45 /* System clock. Primary input clock when in PCI host mode */
  46 #define CONFIG_83XX_CLKIN       66666000        /* 66,666 MHz */
  47
  48 /*
  49  * Local Bus LCRR
  50  *    LCRR:  DLL bypass, Clock divider is 8
  51  *
  52  *    for CSB = 266 MHz it gives LCB clock frequency = 33 MHz
  53  *
  54  * External Local Bus rate is
  55  *    CLKIN * HRCWL_CSB_TO_CLKIN / HRCWL_LCL_BUS_TO_SCB_CLK / LCRR_CLKDIV
  56  */
  57 #define CFG_LCRR                (LCRR_DBYP | LCRR_CLKDIV_8)
  58
  59 /* board pre init: do not call, nothing to do */
  60 #undef CONFIG_BOARD_EARLY_INIT_F
  61
  62 /* detect the number of flash banks */
  63 #define CONFIG_BOARD_EARLY_INIT_R
  64
  65 /*
  66  * DDR Setup
  67  */
  68 #define CFG_DDR_BASE            0x00000000      /* DDR is system memory*/
  69 #define CFG_SDRAM_BASE          CFG_DDR_BASE
  70 #define CFG_DDR_SDRAM_BASE      CFG_DDR_BASE
  71 #define DDR_CASLAT_25                           /* CASLAT set to 2.5 */
  72 #undef CONFIG_DDR_ECC                           /* only for ECC DDR module */
  73 #undef CONFIG_SPD_EEPROM                        /* do not use SPD EEPROM for DDR setup */
  74
  75 #undef CFG_DRAM_TEST                            /* memory test, takes time */
  76 #define CFG_MEMTEST_START       0x00000000      /* memtest region */
  77 #define CFG_MEMTEST_END         0x00100000
  78
  79 /*
  80  * FLASH on the Local Bus
  81  */
  82 #define CFG_FLASH_CFI                           /* use the Common Flash Interface */
  83 #define CFG_FLASH_CFI_DRIVER                    /* use the CFI driver */
  84 #undef CFG_FLASH_CHECKSUM
  85 #define CFG_FLASH_BASE          0x80000000      /* start of FLASH   */
  86
  87 /* buffered writes in the AMD chip set is not supported yet */
  88 #undef CFG_FLASH_USE_BUFFER_WRITE
  89
  90 /*
  91  * FLASH bank number detection
  92  */
  93
  94 /*
  95  * When CFG_MAX_FLASH_BANKS_DETECT is defined, the actual number of Flash
  96  * banks has to be determined at runtime and stored in a gloabl variable
  97  * tqm834x_num_flash_banks. The value of CFG_MAX_FLASH_BANKS_DETECT is only
  98  * used insted of CFG_MAX_FLASH_BANKS to allocate the array flash_info, and
  99  * should be made sufficiently large to accomodate the number of banks that
 100  * might acutally be detected.  Since most (all?) Flash related functions use
 101  * CFG_MAX_FLASH_BANKS as the number of actual banks on the board, it is
 102  * defined as tqm834x_num_flash_banks.
 103  */
 104 #define CFG_MAX_FLASH_BANKS_DETECT      2
 105 #ifndef __ASSEMBLY__
 106 extern int tqm834x_num_flash_banks;
 107 #endif
 108 #define CFG_MAX_FLASH_BANKS (tqm834x_num_flash_banks)
 109
 110 #define CFG_MAX_FLASH_SECT              512     /* max sectors per device */
 111
 112 /* 32 bit device at 0x80000000 via GPCM (0x8000_1801) */
 113 #define CFG_BR0_PRELIM          ((CFG_FLASH_BASE & BR_BA) | \
 114                                         BR_MS_GPCM | BR_PS_32 | BR_V)
 115
 116 /* FLASH timing (0x0000_0c54) */
 117 #define CFG_OR_TIMING_FLASH     (OR_GPCM_CSNT | OR_GPCM_ACS_0b10 | \
 118                                         OR_GPCM_SCY_5 | OR_GPCM_TRLX)
 119
 120 #define CFG_PRELIM_OR_AM        0xc0000000      /* OR addr mask: 1 GiB */
 121
 122 #define CFG_OR0_PRELIM          (CFG_PRELIM_OR_AM  | CFG_OR_TIMING_FLASH)
 123
 124 #define CFG_LBLAWAR0_PRELIM     0x8000001D      /* 1 GiB window size (2^(size + 1)) */
 125 #define CFG_LBLAWBAR0_PRELIM    CFG_FLASH_BASE  /* Window base at flash base */
 126
 127 /* disable remaining mappings */
 128 #define CFG_BR1_PRELIM          0x00000000
 129 #define CFG_OR1_PRELIM          0x00000000
 130 #define CFG_LBLAWBAR1_PRELIM    0x00000000
 131 #define CFG_LBLAWAR1_PRELIM     0x00000000
 132
 133 #define CFG_BR2_PRELIM          0x00000000
 134 #define CFG_OR2_PRELIM          0x00000000
 135 #define CFG_LBLAWBAR2_PRELIM    0x00000000
 136 #define CFG_LBLAWAR2_PRELIM     0x00000000
 137
 138 #define CFG_BR3_PRELIM          0x00000000
 139 #define CFG_OR3_PRELIM          0x00000000
 140 #define CFG_LBLAWBAR3_PRELIM    0x00000000
 141 #define CFG_LBLAWAR3_PRELIM     0x00000000
 142
 143 #define CFG_BR4_PRELIM          0x00000000
 144 #define CFG_OR4_PRELIM          0x00000000
 145 #define CFG_LBLAWBAR4_PRELIM    0x00000000
 146 #define CFG_LBLAWAR4_PRELIM     0x00000000
 147
 148 #define CFG_BR5_PRELIM          0x00000000
 149 #define CFG_OR5_PRELIM          0x00000000
 150 #define CFG_LBLAWBAR5_PRELIM    0x00000000
 151 #define CFG_LBLAWAR5_PRELIM     0x00000000
 152
 153 #define CFG_BR6_PRELIM          0x00000000
 154 #define CFG_OR6_PRELIM          0x00000000
 155 #define CFG_LBLAWBAR6_PRELIM    0x00000000
 156 #define CFG_LBLAWAR6_PRELIM     0x00000000
 157
 158 #define CFG_BR7_PRELIM          0x00000000
 159 #define CFG_OR7_PRELIM          0x00000000
 160 #define CFG_LBLAWBAR7_PRELIM    0x00000000
 161 #define CFG_LBLAWAR7_PRELIM     0x00000000
 162
 163 /*
 164  * Monitor config
 165  */
 166 #define CFG_MONITOR_BASE        TEXT_BASE       /* start of monitor */
 167
 168 #if (CFG_MONITOR_BASE < CFG_FLASH_BASE)
 169 #define CFG_RAMBOOT
 170 #else
 171 #undef  CFG_RAMBOOT
 172 #endif
 173
 174 #define CONFIG_L1_INIT_RAM
 175 #define CFG_INIT_RAM_LOCK       1
 176 #define CFG_INIT_RAM_ADDR       0x20000000      /* Initial RAM address */
 177 #define CFG_INIT_RAM_END        0x1000          /* End of used area in RAM*/
 178
 179 #define CFG_GBL_DATA_SIZE       0x100           /* num bytes initial data */
 180 #define CFG_GBL_DATA_OFFSET     (CFG_INIT_RAM_END - CFG_GBL_DATA_SIZE)
 181 #define CFG_INIT_SP_OFFSET      CFG_GBL_DATA_OFFSET
 182
 183 #define CFG_MONITOR_LEN         (256 * 1024) /* Reserve 256 kB for Mon */
 184 #define CFG_MALLOC_LEN          (128 * 1024) /* Reserved for malloc */
 185
 186 /*
 187  * Serial Port
 188  */
 189 #define CONFIG_CONS_INDEX       1
 190 #undef CONFIG_SERIAL_SOFTWARE_FIFO
 191 #define CFG_NS16550
 192 #define CFG_NS16550_SERIAL
 193 #define CFG_NS16550_REG_SIZE    1
 194 #define CFG_NS16550_CLK         get_bus_freq(0)
 195
 196 #define CFG_BAUDRATE_TABLE  \
 197         {300, 600, 1200, 2400, 4800, 9600, 19200, 38400,115200}
 198
 199 #define CFG_NS16550_COM1        (CFG_IMMRBAR + 0x4500)
 200 #define CFG_NS16550_COM2        (CFG_IMMRBAR + 0x4600)
 201
 202 /*
 203  * I2C
 204  */
 205 #define CONFIG_HARD_I2C                         /* I2C with hardware support    */
 206 #undef CONFIG_SOFT_I2C                          /* I2C bit-banged               */
 207 #define CFG_I2C_SPEED                   400000  /* I2C speed: 400KHz            */
 208 #define CFG_I2C_SLAVE                   0x7F    /* slave address                */
 209 #define CFG_I2C_OFFSET                  0x3000
 210
 211 /* I2C EEPROM, configuration for onboard EEPROMs 24C256 and 24C32 */
 212 #define CFG_I2C_EEPROM_ADDR             0x50    /* 1010000x                     */
 213 #define CFG_I2C_EEPROM_ADDR_LEN         2       /* 16 bit                       */
 214 #define CFG_EEPROM_PAGE_WRITE_BITS      5       /* 32 bytes per write           */
 215 #define CFG_EEPROM_PAGE_WRITE_ENABLE
 216 #define CFG_EEPROM_PAGE_WRITE_DELAY_MS  12      /* 10ms +/- 20%                 */
 217 #define CFG_I2C_MULTI_EEPROMS           1       /* more than one eeprom         */
 218
 219 /* I2C RTC */
 220 #define CONFIG_RTC_DS1337                       /* use ds1337 rtc via i2c       */
 221 #define CFG_I2C_RTC_ADDR                0x68    /* at address 0x68              */
 222
 223 /* I2C SYSMON (LM75) */
 224 #define CONFIG_DTT_LM75                 1       /* ON Semi's LM75               */
 225 #define CONFIG_DTT_SENSORS              {0}     /* Sensor addresses             */
 226 #define CFG_DTT_MAX_TEMP                70
 227 #define CFG_DTT_LOW_TEMP                -30
 228 #define CFG_DTT_HYSTERESIS              3
 229
 230 /*
 231  * TSEC
 232  */
 233 #define CONFIG_TSEC_ENET                /* tsec ethernet support */
 234 #define CONFIG_MII
 235
 236 #define CFG_TSEC1_OFFSET        0x24000
 237 #define CFG_TSEC1               (CFG_IMMRBAR + CFG_TSEC1_OFFSET)
 238 #define CFG_TSEC2_OFFSET        0x25000
 239 #define CFG_TSEC2               (CFG_IMMRBAR + CFG_TSEC2_OFFSET)
 240
 241 #if defined(CONFIG_TSEC_ENET)
 242
 243 #ifndef CONFIG_NET_MULTI
 244 #define CONFIG_NET_MULTI                1
 245 #endif
 246
 247 #define CONFIG_MPC83XX_TSEC1            1
 248 #define CONFIG_MPC83XX_TSEC1_NAME       "TSEC0"
 249 #define CONFIG_MPC83XX_TSEC2            1
 250 #define CONFIG_MPC83XX_TSEC2_NAME       "TSEC1"
 251 #define TSEC1_PHY_ADDR                  0
 252 #define TSEC2_PHY_ADDR                  1
 253 #define TSEC1_PHYIDX                    0
 254 #define TSEC2_PHYIDX                    0
 255
 256 /* Options are: TSEC[0-1] */
 257 #define CONFIG_ETHPRIME                 "TSEC0"
 258
 259 #endif  /* CONFIG_TSEC_ENET */
 260
 261 /*
 262  * General PCI
 263  * Addresses are mapped 1-1.
 264  */
 265 /* FIXME: Real PCI support will come in a follow-up update. */
 266 #undef CONFIG_PCI
 267
 268 #define CFG_PCI1_MEM_BASE       0x80000000
 269 #define CFG_PCI1_MEM_PHYS       CFG_PCI1_MEM_BASE
 270 #define CFG_PCI1_MEM_SIZE       0x20000000      /* 512M */
 271 #define CFG_PCI1_IO_BASE        0x00000000
 272 #define CFG_PCI1_IO_PHYS        0xe2000000
 273 #define CFG_PCI1_IO_SIZE        0x1000000       /* 16M */
 274
 275 #define CFG_PCI2_MEM_BASE       0xA0000000
 276 #define CFG_PCI2_MEM_PHYS       CFG_PCI2_MEM_BASE
 277 #define CFG_PCI2_MEM_SIZE       0x20000000      /* 512M */
 278 #define CFG_PCI2_IO_BASE        0x00000000
 279 #define CFG_PCI2_IO_PHYS        0xe3000000
 280 #define CFG_PCI2_IO_SIZE        0x1000000       /* 16M */
 281 #if defined(CONFIG_PCI)
 282
 283 #define PCI_ALL_PCI1
 284 #if defined(PCI_64BIT)
 285 #undef PCI_ALL_PCI1
 286 #undef PCI_TWO_PCI1
 287 #undef PCI_ONE_PCI1
 288 #endif
 289
 290 #define CONFIG_NET_MULTI
 291 #define CONFIG_PCI_PNP          /* do pci plug-and-play */
 292
 293 #undef CONFIG_EEPRO100
 294 #undef CONFIG_TULIP
 295
 296 #if !defined(CONFIG_PCI_PNP)
 297         #define PCI_ENET0_IOADDR        0xFIXME
 298         #define PCI_ENET0_MEMADDR       0xFIXME
 299         #define PCI_IDSEL_NUMBER        0x0c    /* slot0->3(IDSEL)=12->15 */
 300 #endif
 301
 302 #undef CONFIG_PCI_SCAN_SHOW                     /* show pci devices on startup */
 303 #define CFG_PCI_SUBSYS_VENDORID         0x1057  /* Motorola */
 304
 305 #endif  /* CONFIG_PCI */
 306
 307 /*
 308  * Environment
 309  */
 310 #define CONFIG_ENV_OVERWRITE
 311
 312 #ifndef CFG_RAMBOOT
 313         #define CFG_ENV_IS_IN_FLASH     1
 314         #define CFG_ENV_ADDR            (CFG_MONITOR_BASE + 0x40000)
 315         #define CFG_ENV_SECT_SIZE       0x20000 /* 256K(one sector) for env */
 316         #define CFG_ENV_SIZE            0x2000
 317 #else
 318         #define CFG_NO_FLASH            1       /* Flash is not usable now */
 319         #define CFG_ENV_IS_NOWHERE      1       /* Store ENV in memory only */
 320         #define CFG_ENV_ADDR            (CFG_MONITOR_BASE - 0x1000)
 321         #define CFG_ENV_SIZE            0x2000
 322 #endif
 323
 324 #define CONFIG_LOADS_ECHO               1       /* echo on for serial download */
 325 #define CFG_LOADS_BAUD_CHANGE           1       /* allow baudrate change */
 326
 327 /* Common commands */
 328 #define CFG_CMD_TQM8349_COMMON  CFG_CMD_DATE | CFG_CMD_I2C | CFG_CMD_DTT\
 329                                 | CFG_CMD_PING | CFG_CMD_EEPROM         \
 330                                 | CFG_CMD_MII | CFG_CMD_JFFS2
 331
 332 #if defined(CFG_RAMBOOT)
 333
 334 #if defined(CONFIG_PCI)
 335 #define  CONFIG_COMMANDS        ((CONFIG_CMD_DFL | CFG_CMD_PCI  \
 336                                 | CFG_CMD_TQM8349_COMMON)       \
 337                                 &                               \
 338                                 ~(CFG_CMD_ENV | CFG_CMD_LOADS))
 339 #else
 340 #define  CONFIG_COMMANDS        ((CONFIG_CMD_DFL                \
 341                                 | CFG_CMD_TQM8349_COMMON)       \
 342                                 &                               \
 343                                 ~(CFG_CMD_ENV | CFG_CMD_LOADS))
 344 #endif
 345
 346 #else /* CFG_RAMBOOT */
 347
 348 #if defined(CONFIG_PCI)
 349 #define  CONFIG_COMMANDS        (CONFIG_CMD_DFL | CFG_CMD_PCI   \
 350                                 | CFG_CMD_TQM8349_COMMON)
 351 #else
 352 #define  CONFIG_COMMANDS        (CONFIG_CMD_DFL                 \
 353                                 | CFG_CMD_TQM8349_COMMON)
 354 #endif
 355
 356 #endif /* CFG_RAMBOOT */
 357
 358 #include <cmd_confdefs.h>
 359
 360 /*
 361  * Miscellaneous configurable options
 362  */
 363 #define CFG_LONGHELP                            /* undef to save memory */
 364 #define CFG_LOAD_ADDR           0x2000000       /* default load address */
 365 #define CFG_PROMPT              "=> "           /* Monitor Command Prompt */
 366
 367 #if (CONFIG_COMMANDS & CFG_CMD_KGDB)
 368         #define CFG_CBSIZE      1024            /* Console I/O Buffer Size */
 369 #else
 370         #define CFG_CBSIZE      256             /* Console I/O Buffer Size */
 371 #endif
 372
 373 #define CFG_PBSIZE (CFG_CBSIZE+sizeof(CFG_PROMPT)+16) /* Print Buffer Size */
 374 #define CFG_MAXARGS             16              /* max number of command args */
 375 #define CFG_BARGSIZE            CFG_CBSIZE      /* Boot Argument Buffer Size */
 376 #define CFG_HZ                  1000            /* decrementer freq: 1ms ticks */
 377
 378 #undef CONFIG_WATCHDOG                          /* watchdog disabled */
 379
 380 /*
 381  * For booting Linux, the board info and command line data
 382  * have to be in the first 8 MB of memory, since this is
 383  * the maximum mapped by the Linux kernel during initialization.
 384  */
 385 #define CFG_BOOTMAPSZ   (8 << 20)       /* Initial Memory map for Linux*/
 386
 387 /*
 388  * Cache Configuration
 389  */
 390 #define CFG_DCACHE_SIZE         32768
 391 #define CFG_CACHELINE_SIZE      32
 392 #if (CONFIG_COMMANDS & CFG_CMD_KGDB)
 393 #define CFG_CACHELINE_SHIFT     5       /*log base 2 of the above value*/
 394 #endif
 395
 396 #define CFG_HRCW_LOW (\
 397         HRCWL_LCL_BUS_TO_SCB_CLK_1X1 |\
 398         HRCWL_DDR_TO_SCB_CLK_1X1 |\
 399         HRCWL_CSB_TO_CLKIN_4X1 |\
 400         HRCWL_VCO_1X2 |\
 401         HRCWL_CORE_TO_CSB_2X1)
 402
 403 #if defined(PCI_64BIT)
 404 #define CFG_HRCW_HIGH (\
 405         HRCWH_PCI_HOST |\
 406         HRCWH_64_BIT_PCI |\
 407         HRCWH_PCI1_ARBITER_ENABLE |\
 408         HRCWH_PCI2_ARBITER_DISABLE |\
 409         HRCWH_CORE_ENABLE |\
 410         HRCWH_FROM_0X00000100 |\
 411         HRCWH_BOOTSEQ_DISABLE |\
 412         HRCWH_SW_WATCHDOG_DISABLE |\
 413         HRCWH_ROM_LOC_LOCAL_16BIT |\
 414         HRCWH_TSEC1M_IN_GMII |\
 415         HRCWH_TSEC2M_IN_GMII )
 416 #else
 417 #define CFG_HRCW_HIGH (\
 418         HRCWH_PCI_HOST |\
 419         HRCWH_32_BIT_PCI |\
 420         HRCWH_PCI1_ARBITER_ENABLE |\
 421         HRCWH_PCI2_ARBITER_ENABLE |\
 422         HRCWH_CORE_ENABLE |\
 423         HRCWH_FROM_0X00000100 |\
 424         HRCWH_BOOTSEQ_DISABLE |\
 425         HRCWH_SW_WATCHDOG_DISABLE |\
 426         HRCWH_ROM_LOC_LOCAL_16BIT |\
 427         HRCWH_TSEC1M_IN_GMII |\
 428         HRCWH_TSEC2M_IN_GMII )
 429 #endif
 430
 431 /* i-cache and d-cache disabled */
 432 #define CFG_HID0_INIT           0x000000000
 433 #define CFG_HID0_FINAL          CFG_HID0_INIT
 434 #define CFG_HID2                0x000000000
 435
 436 /*
 437  * Internal Definitions
 438  *
 439  * Boot Flags
 440  */
 441 #define BOOTFLAG_COLD           0x01    /* Normal Power-On: Boot from FLASH */
 442 #define BOOTFLAG_WARM           0x02    /* Software reboot */
 443
 444 #if (CONFIG_COMMANDS & CFG_CMD_KGDB)
 445 #define CONFIG_KGDB_BAUDRATE    230400  /* speed of kgdb serial port */
 446 #define CONFIG_KGDB_SER_INDEX   2       /* which serial port to use */
 447 #endif
 448
 449 /*
 450  * Environment Configuration
 451  */
 452
 453 #if defined(CONFIG_TSEC_ENET)
 454 #define CONFIG_ETHADDR          D2:DA:5E:44:BC:29
 455 #define CONFIG_HAS_ETH1
 456 #define CONFIG_ETH1ADDR         1E:F3:40:21:92:53
 457 #endif
 458
 459 #define CONFIG_IPADDR           192.168.205.1
 460
 461 #define CONFIG_HOSTNAME         tqm8349
 462 #define CONFIG_ROOTPATH         /opt/eldk/ppc_6xx
 463 #define CONFIG_BOOTFILE         /tftpboot/tqm83xx/uImage
 464
 465 #define CONFIG_SERVERIP         192.168.1.1
 466 #define CONFIG_GATEWAYIP        192.168.1.1
 467 #define CONFIG_NETMASK          255.255.255.0
 468
 469 #define CONFIG_LOADADDR         200000  /* default location for tftp and bootm */
 470
 471 #define CONFIG_BOOTDELAY        6       /* -1 disables auto-boot */
 472 #undef  CONFIG_BOOTARGS                 /* the boot command will set bootargs */
 473
 474 #define CONFIG_BAUDRATE         115200
 475
 476 #define CONFIG_PREBOOT  "echo;" \
 477         "echo Type \"run flash_nfs\" to mount root filesystem over NFS;" \
 478         "echo"
 479
 480 #undef  CONFIG_BOOTARGS
 481
 482 #define CONFIG_EXTRA_ENV_SETTINGS                                       \
 483         "netdev=eth0\0"                                                 \
 484         "hostname=tqm83xx\0"                                            \
 485         "nfsargs=setenv bootargs root=/dev/nfs rw "                     \
 486                 "nfsroot=$(serverip):$(rootpath)\0"                     \
 487         "ramargs=setenv bootargs root=/dev/ram rw\0"                    \
 488         "addip=setenv bootargs $(bootargs) "                            \
 489                 "ip=$(ipaddr):$(serverip):$(gatewayip):$(netmask)"      \
 490                 ":$(hostname):$(netdev):off panic=1\0"                  \
 491         "addtty=setenv bootargs $(bootargs) console=ttyS0,$(baudrate)\0"\
 492         "flash_nfs=run nfsargs addip addtty;"                           \
 493                 "bootm $(kernel_addr)\0"                                \
 494         "flash_self=run ramargs addip addtty;"                          \
 495                 "bootm $(kernel_addr) $(ramdisk_addr)\0"                \
 496         "net_nfs=tftp 200000 $(bootfile);run nfsargs addip addtty;"     \
 497                 "bootm\0"                                               \
 498         "rootpath=/opt/eldk/ppc_6xx\0"                                  \
 499         "bootfile=/tftpboot/tqm83xx/uImage\0"                           \
 500         "kernel_addr=80060000\0"                                        \
 501         "ramdisk_addr=80160000\0"                                       \
 502         "load=tftp 100000 /tftpboot/tqm83xx/u-boot.bin\0"               \
 503         "update=protect off 80000000 8003ffff; "                        \
 504                 "era 80000000 8003ffff; cp.b 100000 80000000 40000\0"   \
 505         "upd=run load;run update\0"                                     \
 506         ""
 507
 508 #define CONFIG_BOOTCOMMAND      "run flash_self"
 509
 510 /*
 511  * JFFS2 partitions
 512  */
 513 /* mtdparts command line support */
 514 #define CONFIG_JFFS2_CMDLINE
 515 #define MTDIDS_DEFAULT          "nor0=TQM834x-0"
 516
 517 /* default mtd partition table */
 518 #define MTDPARTS_DEFAULT        "mtdparts=TQM834x-0:256k(u-boot),128k(env),"\
 519                                                 "1m(kernel),2m(initrd),"\
 520                                                 "-(user);"\
 521
 522 #endif  /* __CONFIG_H */